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Ultra-thin die and method of fabricating same 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-029/06
출원번호 US-0211556 (2008-09-16)
등록번호 US-8198705 (2012-06-12)
발명자 / 주소
  • Mancini, David P.
  • Chung, Young Sir
  • Dauksher, William J.
  • Weston, Donald F.
  • Young, Steven R.
  • Baird, Robert W.
출원인 / 주소
  • Freescale Semiconductor, Inc.
인용정보 피인용 횟수 : 1  인용 특허 : 22

초록

In accordance with a specific embodiment, a method of processing a semiconductor substrate is disclosed whereby the substrate is thinned, and the dice formed on the substrate are singulated by a common process. Trench regions are formed on a backside of the substrate. An isotropic etch of the backsi

대표청구항

1. A device comprising a semiconductor die comprising a substrate, the substrate comprising a first major surface at which a semiconductor device is formed, and a minor surface having a roughness of a scalloping nature, wherein the minor surface is perpendicular to the major surface. 2. The device o

이 특허에 인용된 특허 (22)

  1. Wark James M. ; Bettinger Michael J., Apparatus and method for facilitating circuit board processing.
  2. John A. Iacoponi ; John C. Miethke, Backside contact for integrated circuit and method of forming same.
  3. Lesk Israel A. ; Davies Robert B. ; Rutter Robert E. ; Clark Lowell E., Backside processing method.
  4. Brian S. Doyle ; Chunlin Liang ; Brian E. Roberds, Dynamic threshold voltage device and methods for fabricating dynamic threshold voltage devices.
  5. Leedy, Glenn Joseph, Membrane 3D IC fabrication.
  6. Tandy, William D; Street, Bret K., Method and apparatus for marking a bare semiconductor die.
  7. Kuroda Hideo (Hannancho JPX) Taniguchi Masao (Sennan JPX), Method for dicing a semiconductor wafer.
  8. Yeom, Geun-young; Yoo, Myung cheol; Urbanek, Wolfram; Sung, Youn-joon; Jeong, Chang-hyun; Kim, Kyong-nam; Kim, Dong-woo, Method of etching substrates.
  9. Kia Silverbrook AU, Method of fabricating devices incorporating microelectromechanical systems using UV curable tapes.
  10. Leedy,Glenn J, Method of information processing using three dimensional integrated circuits.
  11. Li Jian ; Winer Paul ; DeGrush Adam J. ; Maher Steven P., Method of making a circuit edit interconnect structure through the backside of an integrated circuit die.
  12. Tandy, William D.; Street, Bret K., Methods for marking a bare semiconductor die.
  13. Loughhead David Garrett ; Lin Xiao-Fa ; Weikert Robert James ; Flippin Lee Allen, Phenoxymethyl piperidine derivatives for the treatment of neuropathic pain.
  14. Hantschel Thomas,DEX ; Vandervorst Wilfried,BEX, Probe tip configuration and a method of fabrication thereof.
  15. Wood Alan G. ; Farnworth Warren M., Process for packaging a semiconductor die using dicing and testing.
  16. Kakihana Sanehiko (San Francisco CA), Process for producing an integrated circuit device with substrate via hole and metallized backplane.
  17. Igel Guenter,DEX ; Mall Martin,DEX, Process for separating electronic devices.
  18. Morcom William R. ; Ahrens Stephen C. ; Spindler Jeffrey P. ; Ford Raymond T. ; Lauffer Jeffrey E., Self-supported ultra thin silicon wafer process.
  19. Enquist,Paul M., Three dimensional device integration method and integrated device.
  20. Leedy, Glenn J., Three dimensional structure integrated circuit fabrication process.
  21. Peters Steven A., Vending system.
  22. Pogge H. Bernhard ; Davari Bijan ; Greschner Johann,DEX ; Kalter Howard L., Very dense chip package.

이 특허를 인용한 특허 (1)

  1. Schrems, Martin; Stering, Bernhard; Schrank, Franz, Dicing method.
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