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Circuit design information generating equipment, function execution system, and memory medium storing program

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-017/50
  • G06F-013/36
  • G06F-009/26
출원번호 US-0725908 (2010-03-17)
등록번호 US-8359564 (2013-01-22)
우선권정보 JP-2009-170480 (2009-07-21)
발명자 / 주소
  • Yamada, Kazuo
출원인 / 주소
  • Fuji Xerox Co., Ltd.
인용정보 피인용 횟수 : 0  인용 특허 : 21

초록

A design information generating equipment is provided. A control component of the design information generating equipment, when a basic function of the plurality of functions constitutes a requested function, and design information that corresponds to the basic function is stored in a second memory

대표청구항

1. A circuit design information generating equipment, comprising: a first memory area that stores a source program which corresponds to at least one basic function of a plurality of functions;a second memory area that associates circuit design information used to reconfigure a circuit with the basic

이 특허에 인용된 특허 (21)

  1. Sasaki, Nobuo; Yamanoue, Kaoru; Takahashi, Yoshikazu; Honda, Shinichi, Activator, DMA transfer system, DMA transfer method.
  2. DeHaemer, Eric, Addressing device resources in variable page size environments.
  3. Masuda,Atsushi; Mizuno,Atsushi, Apparatus, method and program for designing semiconductor integrated circuit.
  4. Haji Aghajani,Kazem; Hayes,Christopher L, Common interface framework for developing field programmable device based applications independent of a target circuit board.
  5. Andrade,Hugo A.; Odom,Brian Keith; Butler,Cary Paul; Peck,Joseph E.; Petersen,Newton G., Debugging a program intended to execute on a reconfigurable device using a test feed-through configuration.
  6. Oved, Tzah, Device, system, and method of distributing messages.
  7. Passerini,Ron; Zhang,Tianming, Generation and use of a time map for accessing a prior image of a storage device.
  8. Pochayevets,Oleandr; Siegl,Johann; Eichele,Herbert, HDL preprocessor.
  9. Yoshio Nishihara JP; Yoshihide Sato JP; Norikazu Yamada JP; Hiroyuki Miyake JP; Eigo Nakagawa JP, Information processing system that processes portions of an application program using programmable logic circuits.
  10. Jacobson, Neil G.; Flores, Jr., Emigdio M.; Srivastava, Sanjay; Dai, Bin; Mao, Sungnien Jerry; Chow, Rosa M. Y.; Tawade, Pushpasheel, Management of configuration data by generating a chain description data set that specifies an order of configuration chain for multi-device systems.
  11. Schumacher, Paul R.; McMurtrey, Daniel L; Yang, Shengqi, Method and apparatus for designing an embedded system for a programmable logic device.
  12. Mykland, Robert Keith, Method and apparatus for directing a computational array to execute a plurality of successive computational array instructions at runtime.
  13. Timothy Merrick Long AU; Michael John Webb AU; Christopher Amies AU, Method, apparatus and system for managing virtual memory with virtual-physical mapping.
  14. Reese, David L.; Yates, Jr., John S.; Hohensee, Paul H.; Van Dyke, Korbin S.; Ramesh, T. R.; Thusoo, Shalesh; Saund, Gurjeet Singh; Patkar, Niteen Aravind, Profiling of computer programs executing in virtual memory systems.
  15. Riley, Paul; Davies, Clive; Scott, Iain; Dettmar, Chris; Draper, Andrew, Reconfigurable programmable logic system with peripheral identification data.
  16. Johnsen, Bjørn Dag; Tørudbakken, Ola, Routing direct memory access requests using doorbell addresses.
  17. Davies, Ian Robert, Safe message transfers on PCI-Express link from RAID controller to receiver-programmable window of partner RAID controller CPU memory.
  18. Marui, Shinichi, Semiconductor integrated circuit, program transformation apparatus, and mapping apparatus.
  19. Grosner,George; Wood,Douglas, Switching system method for discovering and accessing SCSI devices in response to query.
  20. Wong-Lam, Ho Wai; Naley, Mark Douglas; Geven, Albertus Franciscus Maria; Hessel, Henk Albert, System and method for accessing internal registers in integrated circuits.
  21. Taylor Brad (Oakland CA) Dowling Robert (Albany CA), System for compiling algorithmic language source code for implementation in programmable hardware.
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