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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0941075 (2010-11-07) |
등록번호 | US-8373439 (2013-02-12) |
발명자 / 주소 |
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출원인 / 주소 |
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인용정보 | 피인용 횟수 : 3 인용 특허 : 305 |
A wafer includes a group of tiles of programmable logic formed thereon, wherein each tile comprises a micro control unit (MCU) communicating with adjacent MCUs, and wherein each MCU is controlled in a predetermined order of priority by adjacent MCUs; and dice lines on the wafer to separate the group
1. A wafer, comprising: a group of tiles of programmable logic formed thereon, wherein each tile comprises a micro control unit (MCU) communicating with adjacent MCUs on one layer to configure the group of tiles, and wherein each MCU is controlled in a predetermined order of priority by adjacent MCU
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