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Unified system architecture for elliptic-curve cryptography 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H04L-009/30
  • H04L-009/28
  • H04L-009/00
  • G06F-007/72
  • H04K-001/00
출원번호 US-0772163 (2007-06-30)
등록번호 US-8781110 (2014-07-15)
발명자 / 주소
  • Gopal, Vinodh
  • Ozturk, Erdinc
  • Wolrich, Gilbert
  • Feghali, Wajdi K.
출원인 / 주소
  • Intel Corporation
대리인 / 주소
    Grossman, Tucker, Perreault & Pfleger, PLLC
인용정보 피인용 횟수 : 1  인용 특허 : 18

초록

A system for performing public key encryption is provided. The system supports mathematical operations for a plurality of public key encryption algorithms such as Rivert, Shamir, Aldeman (RSA) and Diffie-Hellman key exchange (DH) and Elliptic Curve Cryptosystem (ECC). The system supports both prime

대표청구항

1. An apparatus comprising: a plurality of modular math processors, each modular math processor having a program store and a control register to store a configuration mode and a hold/release indicator;a plurality of multipliers; andan arbiter circuitry configured to control access to each of the plu

이 특허에 인용된 특허 (18)

  1. Ramchandran, Amit, Adaptable datapath for a digital processing system.
  2. Gressel, Carmi David; Hadad, Isaac; Dror, Itai; Molchanov, Alexey; Mostovoy, Michael, Apparatus and method for modular multiplication and exponentiation based on montgomery multiplication.
  3. Chong,Jike; Olson,Christopher; Grohoski,Gregory F., Apparatus and method for sharing a functional unit execution resource among a plurality of functional units.
  4. Shiba,Masue; Kawamura,Shinichi, Arithmetic method and apparatus and crypto processing apparatus for performing multiple types of cryptography.
  5. Thiel Geoffrey L. (Surrey GBX) Pontin Paul S. (Surrey GBX), Computer system using multidimensional addressing between multiple processors having independently addressable internal.
  6. Kaplan, Michael M.; Ober, Timothy; Reed, Peter; Doud, Robert W., Cryptographic co-processor.
  7. Freking, William L.; Parhi, Keshab K. P, Fast parallel cascaded array modular multiplier.
  8. Gura,Nils; Eberle,Hans, Generic modular multiplier using partial reduction.
  9. Eberle,Hans; Gura,Nils; Finchelstein,Daniel; Chang Shantz,Sheueling; Gupta,Vipul, Hardware accelerator for elliptic curve cryptography.
  10. Schuster Stanley Everett ; Cook Peter William, Interlocked pipelined CMOS.
  11. Gilbert Ira H., Mesh parallel computer architecture apparatus and associated methods.
  12. Grohoski,Gregory F.; Jordan,Paul J.; Wong,Michael K.; Kohn,Leslie D., Methods and systems for efficiently integrating a cryptographic co-processor.
  13. Henry, G. Glenn; Crispin, Thomas A.; Parks, Terry, Microprocessor apparatus and method for enabling configurable data block size in a cryptographic engine.
  14. Kneib Kristine N. (San Diego CA), Multiprocessor system employing dynamically programmable processing elements controlled by a master processor.
  15. Fuller, Joseph B., Programmable data bus.
  16. Sueyoshi, Toshinori; Iida, Masahiro; Amagasaki, Motoki; Taketa, Kazuhiko; Heishi, Taketo; Suzuki, Nobuharu, Reconfigurable logic block, programmable logic device provided with the reconfigurable logic block, and method of fabricating the reconfigurable logic block.
  17. Dent,Paul W.; Smeets,Ben; Croughwell, III,William J., Recursive cryptoaccelerator and recursive VHDL design of logic circuits.
  18. Even Shimon (Haifa ILX), Systolic array for modular multiplication.

이 특허를 인용한 특허 (1)

  1. Little, Sean; Anderson, Jordan, Systolic parallel Galois hash computing device.
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