[보고서]차세대 우주용 고속자료 처리장치의 요소기술 연구 및 우주 환경시험 절차 개발

강경인

차세대 우주용 고속자료 처리장치의 요소기술 연구 및 우주 환경시험 절차 개발
Research & Development of High Speed Data Processing for Space Application 원문보기

보고서 정보
주관연구기관	한국과학기술원 Korea Advanced Institute of Science and Technology
연구책임자	강경인
참여연구자	오대수 , 신근수 , 임철우 , 이철 , 박성옥 , 이종주 , 오승한 , 김진규 , 서정기
보고서유형	최종보고서
발행국가	대한민국
언어	한국어
발행년월	2012-08
주관부처	교육과학기술부
사업 관리 기관	한국연구재단
등록번호	TRKO201300023532
DB 구축일자	2013-08-26
키워드	고속자료처리,우주환경시험,메모리 모듈,인공위성High Speed Data Processing,Environment Test,Memory Module,10Gbps,EMI

초록

III. 연구개발의 내용 및 범위
- 10Gbps급 위성영상 자료 입/출력 요소기술 개발
- EMI 영향 분석 및 연구
- 저장부(DSM) 보드 개발
- EGSE_Tx 보드 개발
- 우주급 PCB의 규격분석 및 EEE부품의 인증계획 작성
- 우주환경시험절차 작성
- 고속자료 처리장치의 성능검증

Abstract ▼

As the semiconductor technology is improved, the performance of satellites developing these days require more accurate and much data when accomplishing earth observation mission. Especially, the advanced countries are developing high speed data processing system to cover these requirements. Also, these technologies are grouped into expert restricted items. Therefore, from this project, high speed data processing unit of next generation for space and space environment validation process will be studied, since there is no much semiconductor technology gap between advanced countries and domestic country.
The detailed contents to develop the high speed data processing unit of next generation for space and space environment validation process are as follows.
( 10Gbps high speed data I/O interface core technology development )
As the key technology for this study, after analyzing and researching of the commercial and space high speed data processing interface, we are trying to design, implement and verify the performance.
( EMI effect study )
The EMI effect will be analyzed about the developed high speed data processing system. After then, the EMI control method will be developed.
( DSM Board Development)
Mass memory board hardware and Memory control FPGA for DSM (Data Storage Module) will be developed.
( Space environment test of PCB and latest electric device )
After space environment data of PCB and latest electric device, space verification method will be researched for the flight model.
( Performance valification of high speed data processing system )
From the performance verification of the developed high speed data processing system, space verification method will be researched for the flight model.

목차 Contents

표지 ... 1
제출문 ... 2
보고서 요약서 ... 3
요약문 ... 4
SUMMARY ... 6
CONTENTS ... 7
제 1장. 연구개발과제의 개요 ... 9
1절. 연구개발의 목적 및 필요성 ... 9
1. 기술적 측면 ... 9
2. 경제·산업적 측면 ... 9
3. 사회·문화적 측면 ... 9
2절. 연구개발의 범위 ... 10
제 2장. 국내외 기술개발 현황 ... 11
1절. 국내외 기술 수준 ... 11
제 3장. 연구개발 수행내용 및 결과 ... 14
1절. 10Gbps급 위성영상 자료 입/출력을 위한 요소기술 개발 ... 14
1. 고속 입/출력 기술동향 분석 ... 14
2. 고속 입/출력 Interface 분석 ... 22
2절. EMI 영향분석 연구 ... 29
3절. 저장부 (DSM) 개발 ... 33
1. 상위설계 ... 33
2. HW개발 ... 42
2. Code개발 ... 43
4절. EGSE_Tx 개발 ... 70
1. 주요 스펙 및 형상 ... 70
2. 시스템 제작 ... 72
3. Interface 상세 구현 ... 74
5. 대용량 파일 전송 ... 79
6. Image Data Formatting 데이터 전송 시험 ... 81
5절. 우주급 PCB의 규격분석 및 EEE부품의 인증계획 작성 ... 86
1. 우주급 PCB의 규격분석 ... 86
2. EEE부품의 인증계획 작성 ... 86
6절. 우주환경시험 절차 개발 ... 87
1. Shock Test 절차 ... 87
2. Vibration Test ... 93
3. Thermal Vacuum Test 절차서 ... 98
7절. 고속자료 처리장치의 성능검증 ... 100
제 4장. 목표달성도 및 관련분야에의 기여도 ... 101
1절. 연구개발목표의 달성도 ... 101
2절. 관련분야의 기술발전 기여도 ... 101
3절. 논문, 학회발표, 특허 ... 102
제 5장. 연구개발결과의 활용계획 ... 105
제 4장. 참고문헌 ... 106

표/그림 (84)

표 위성용 프로세서의 활용
표 국내 위성용 고속자료처리장치 연구개발 실적
표 메모리 동작 원리 비교
표 DDR Stack Memory
표 DDR Base Memory Functional Block Diagram
표 DDR Base Memory Simplified State Diagram
표 Buffered type의 System 구성 구조 [1]
표 Buffered type의 System 구성 구조 [2]
표 Unbuffered type의 System 구성 구조
표 SSTL2 Double Ended Termination
표 SSTL2 Single Ended Termination
표 Code Block Diagram
표 DSM Code
표 Modular Memory Interface Representation
표 Hierarchical Structure of Virtex-5 FPGA DDR SDRAM Design
표 Top-Level Block Diagram of the DDR SDRAM Design with a PLL and a Testbench
표 Xilinx ISE CORE Generator Set(1)
표 Xilinx ISE CORE Generator Set(2)
표 Xilinx ISE CORE Generator Set(3)
표 Xilinx Memory XilinxiInterface Generator Set(1)
표 Xilinx Memory Interface Generator Set(2)
표 Xilinx Memory Interface Generator Set(3)
표 Xilinx Memory Interface Generator Set(4)
표 Xilinx Memory Interface Generator Set(5)
표 Xilinx Memory Interface Generator Set(6)
표 Xilinx Memory Interface Generator Set(7)
표 Xilinx Memory Interface Generator Set(8)
표 Xilinx Memory Interface Generator Set(9)
표 Xilinx Memory Interface Generator Set(10)
표 Xilinx Memory Interface Generator Set(11)
표 Xilinx Memory Interface Generator Set(12)
표 Xilinx Memory Interface Generator Set(13)
표 Xilinx Memory Interface Generator Set(14)
표 Xilinx Memory Interface Generator Set(15)
표 Xilinx Memory Interface Generator Set(16)
표 DDR Core Simulation Write/Read 결과
표 DDR Core Simulation DDR 메모리의 초기화 결과
표 DDR Core Simulation DDR 메모리 Write 결과
표 DDR Core Simulation DDR 메모리 Read 결과
표 DDR 메모리 Write 제어신호
표 Memory Write Test
표 DDR 메모리 Read 제어신호
표 Memory Read Test
표 10Gbps 구현 하기위한 SerDes 구성도
표 Clock Data Recovery
표 단일채널 2~3Gbps급 Giga IO Test Configuration
표 광 채널 BER실험 구성
표 광채널 BER 실험 결과 정리
표 SMA 채널 BER 실험 구성
표 SMA 채널 BER 실험 결과
표 SMA 채널 BER 실험 결과 정리
표 아이패턴 측정 조건
표 광 채널 Tx near end 측정 파형
표 광 채널 Tx near end 아이패턴 측정 결과
표 광 채널 Tx far end 측정 파형
표 광 채널 Tx far end 아이패턴 측정 결과
표 SMA 채널 Tx near end 측정 파형
표 SMA 채널 Tx near end 아이패턴 측정 결과
표 SMA 채널 Tx far end 측정 파형
표 SMA 채널 Tx far end 아이패턴 측정 결과
표 DSM MGT BER ChipScop 측정
표 DSM MGT BER 측정 조건
표 DSM MGT BER 측정 결과
표 Xilinx사 시험결과
표 Standard Format
표 Control Data Format
표 Xilinx ISE CORE Generator 선택(1)
표 Xilinx ISE CORE Generator 선택(2)
표 Xilinx ISE CORE Generator 선택(3)
표 Xilinx ISE CORE Generator 선택(4)
표 Xilinx ISE CORE Generator 선택(5)
표 Xilinx ISE CORE Generator 선택(6)
표 Xilinx ISE CORE Generator 선택(7)
표 Xilinx ISE CORE Generator 선택(8)
표 Xilinx ISE CORE Generator 선택(9)
표 Xilinx ISE CORE Generator 선택(10)
표 Xilinx ISE CORE Generator 선택(11)
표 Giga IO MGT 코드
표 Giga IO Frame
표 Giga IO MGT 시험 결과
표 EGSE_Tx 형상
표 Low-level random vibration level
표 Random Vibration Level
표 Key constraints on the components of STSAT-2 PFM

과제명(ProjectTitle) :	-
연구책임자(Manager) :	-
과제기간(DetailSeriesProject) :	-
총연구비 (DetailSeriesProject) :	-
키워드(keyword) :	-
과제수행기간(LeadAgency) :	-
연구목표(Goal) :	-
연구내용(Abstract) :	-
기대효과(Effect) :	-

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