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積層型 세라믹 커패시터가 波動납땜工程을 거치는 동안 발생할 수 있는 熱衝擊에 기인한 결함률을 最少化할 수 있는 最適 조건들이 연구되었다. 주석과 납의 重量比가 63:37인 땜납과 표면장착용 적층형 세라믹 패시터의 크기가 18mil×25 mil인 경우에 있어서,
The optimum conditions to minimize the defect rate of multilayer ceramic capacitors due to the thermal shock during the automatic wave soldering process have been investigated. In the case of using the solder alloy of 63wt% Sn and 37wt% Pb and the physical dimension of 18mi1 × 25mi1 surface mounting...
Abstract
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Keyword
저자 | 정사진 |
---|---|
학위수여기관 | 慶北大學校 |
학위구분 | 국내석사 |
학과 | 電子材料專攻 |
발행연도 | 1989 |
총페이지 | 25장 |
키워드 | 세라믹 커패시터 열충격 최소화 적층형 |
언어 | kor |
원문 URL | http://www.riss.kr/link?id=T2154547&outLink=K |
정보원 | 한국교육학술정보원 |
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