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NTIS 바로가기반도체및디스플레이장비학회지 = Journal of the semiconductor & display equipment technology, v.7 no.2, 2008년, pp.23 - 27
이경인 (단국대학교 전자전기공학과) , 임승범 (단국대학교 전자전기공학과) , 정용민 (단국대학교 전자전기공학과) , 오은태 (단국대학교 전자전기공학과) , 이준영 (단국대학교 전자전기공학과)
Recently, regulation for THD (Total Harmonic Distortion) such as IEC 61000-3-2, IEEE 519 is being reinforced about a product which directly connects to AC line in order to prevent distortion of common power source in electronic equipment and electrical machinery. In order to satisfy these regulation...
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핵심어 | 질문 | 논문에서 추출한 답변 |
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이단 역률개선 회로는 무엇으로 구성되어 있는가? | Fig. 1에 도시한 이단 역률개선 회로는 전류를 제어 하여 역률을 개선하는 PFC(Power Factor Correction) 단과 출력전압을 조정하는 DC/DC 컨버터 단으로 구성되어 있다. 이단 역률개선 회로는 PFC단과 DC/DC 컨버터 단을 각각 설계함으로써 고역률, 낮은 고조파 왜곡, 충분한 에너지 축적시간 등의 장점을 가지고 있지만, PFC단과 DC/DC 컨버터 단을 서로 독립된 제어기와 스위치로 제어하므로 회로가 복잡해지고 제작비용이 많이 들며 두 번의 전력 변환 단계를 거치므로 전체적인 효율이 감소하는 단점이 있다[2,4]. | |
본 논문에서는 역률 보상 회로와 DC/DC 컨버터를 하나로 합친 단일 역률개선 플라이백 컨버터를 제안하였으며 Hold-up 규제를 극복하기 위하여 보조회로를 추가하였다, 제안한 회로에 대한 실험 결과는? | 또한 실험을 통하여 제안한 회로의 유용성을 입증하였다. 실험 결과 입력전압 AC 110[V]에서는 전부하시 효율은 92%, 역률은 0.99로 단위 역률에 가깝고, AC 220[V]에서는 효율은 91%이고, 역률은 0.95로 IEC 61000-3-2, IEEE 519를 만족하며 전압유지 시간도 400ms로 Hold-up 규제를 만족한다. | |
이단 역률개선 회로의 장단점은? | 1에 도시한 이단 역률개선 회로는 전류를 제어 하여 역률을 개선하는 PFC(Power Factor Correction) 단과 출력전압을 조정하는 DC/DC 컨버터 단으로 구성되어 있다. 이단 역률개선 회로는 PFC단과 DC/DC 컨버터 단을 각각 설계함으로써 고역률, 낮은 고조파 왜곡, 충분한 에너지 축적시간 등의 장점을 가지고 있지만, PFC단과 DC/DC 컨버터 단을 서로 독립된 제어기와 스위치로 제어하므로 회로가 복잡해지고 제작비용이 많이 들며 두 번의 전력 변환 단계를 거치므로 전체적인 효율이 감소하는 단점이 있다[2,4]. |
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