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초록
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본 논문에서는 40G/100G 이더넷의 구조적 특징을 고려하여 PCS(Physical Coding Sublayer) 송수신부를 설계하고 로직 시뮬레이션을 통하여 각 모듈의 기능을 검증한다. 이를 위하여 PCS 송수신부의 기능 모듈 및 입출력 신호를 정의하고 HDL 프로그래밍 언어를 사용하여 각 가능을 구현하였다. 설계한 PCS 송수신부는 64B/66B 인코딩과 디코팅, 동작 모드에 따른 스크램블링과 디스크램블링, 송수신 프레임의 유효성 여부 판단 기능, 다중 레인 분배 및 정렬 기능을 제공한다. 설계한 PCS 송수신부의 기능 검증을 위하여 ModelSim 시뮬레이터를 이용하였으며, 입력 데이터에 따른 모듈 동작 및 타이밍 관점에서 기능을 확인하였다. 이를 통하여 설계한 PCS 송수신부의 각 기능 모듈에 올바르게 동작함을 확인할 수 있었다.

Abstract AI-Helper 아이콘AI-Helper

In this paper, we design the PCS(Physical Coding Sublayer) transmitting and receiving module for 400/1000 Ethernet and verify the performance of it through logic simulation. In this work, we defined each function module and internal/external control signals and implemented them using HDL programming...

주제어

AI 본문요약
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문제 정의

  • 본 논문에서는 40G/100G 이더 넷의 구조적 특성을 고려하여 PCS의 주요 기능 블록을 설계하고 로직 시뮬레이션을 통한 기능 검증을 수행한다. 이를 위하여 PCS의 주요 기능 모듈 및 입출력 신호를 정의하고 HDL 프로그래밍 언어를 사용하여 각 기능을 구현하였다 설계한 PCS 송수신부는 64B/66B인코딩과 디코딩, 모드에 따른 스크램블링과 디스크램블링, 송수신 프레임의 유효성 여부 판단 기능, 다중 레인 분배 및 정렬 기능을 제공한다.

가설 설정

  • .송수신 프레임의 유효성 여부를 판단하고 에러 검출 기능을 제공해야 한다.
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참고문헌 (6)

  1. J. D'Ambrosia, "40 Gigabit Ethernet and 100 Gigabit Ethernet: The Development of a Flexible Architecture," IEEE Communications Magazine, Vol.47, pp.S8-S14, 2009. 

  2. G. Lehmann and R. H. Derksen, "100 Gigabit Ethernet Transmission - Physical Layer Issues," in Proceedings of OFC/NFOEC2007, pp.1-3, March 2007. 

  3. M. Duelk and M. Zirngibl, "100 Gigabit Ethernet - Applications, Features, Challenges," in Proceedings of INFOCOM2006, pp.1-5, April 2006. 

  4. The Road to 100G Networking, Ciena Corp., Linthicum, MD, 2008. 

  5. An Overview of Next-Generation 100 and 40 Gigabit Ethernet Technologies, Ixia Worldwide Headquarters, Calabasas, CA, 2008. 

  6. Part3: Carrier Sense Multiple Access with Collision Detection (CSMA/CD) Access Method and Physical Layer Specifications, IEEE std 802.3ba TM/D2.0, 2009. 

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