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A Low Power Dual CDS for a Column-Parallel CMOS Image Sensor 원문보기

Journal of semiconductor technology and science, v.12 no.4, 2012년, pp.388 - 396  

Cho, Kyuik (Dongguk Univ.-Seoul, Dept. of Semiconductor Science) ,  Kim, Daeyun (Dongguk Univ.-Seoul, Dept. of Semiconductor Science) ,  Song, Minkyu (Dongguk Univ.-Seoul, Dept. of Semiconductor Science)

Abstract ▼ AI-Helper 아이콘AI-Helper

In this paper, a $320{\times}240$ pixel, 80 frame/s CMOS image sensor with a low power dual correlated double sampling (CDS) scheme is presented. A novel 8-bit hold-and-go counter in each column is proposed to obtain 10-bit resolution. Furthermore, dual CDS and a configurable counter sche...

주제어

#CMOS image sensor   #correlated double sampling   #digital CDS   #dual CDS  

AI 본문요약
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제안 방법

  • 1 LSB at dark. To take the column FPN, we captured 30 images at dark and analysis the data by using the program with calculations of temporal average, spatial average, and deviation.

대상 데이터

  • 5. The image sensor is composed of a pixel array, two side column parallel readout circuits, and digital control blocks. The pixel array is based on the 4T two-shared pinned-photodiode [11, 14] with a pixel pitch of 2.
  • The prototype CMOS image sensor was fabricated by a 0.13 µm 1P4M CMOS process.
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참고문헌 (16)

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