[논문]The Implementation of Sigma-Delta ADC/DAC Digital Block

Park, Sang-Bong; Lee, Young Dae; Watanabe, Koki

doi:10.7236/ijibc.2013.5.2.11

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The Implementation of Sigma-Delta ADC/DAC Digital Block 원문보기

International journal of internet, broadcasting and communication : IJIBC, v.5 no.2, 2013년, pp.11 - 14

Park, Sang-Bong (Department of Information and Communication,semyung university) , Lee, Young Dae (Department of Digital Media Engineering, Anyang University) , Watanabe, Koki (Department of Information and Communication Engineering, Fukuoka Institute of Technology)

Abstract ▼ AI-Helper

This paper describes the sigma-delta ADC/DAC digital block with two channels. The ADC block has comb filter and three half band filters. And the DAC block has 5th Cascaded-of-Integrators Feedback DSM. The ADC and DAC support I2S, RJ, LJ and selectable input data modes of 24bit, 20bit, and 16bit. It is fabricated with 0.35um Hynix standard CMOS cell library. The chip size is 3700*3700um. It has been verified using NC Verilog Simulator and Matlab Tool.

주제어

AI 본문요약
AI-Helper

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대상 데이터

The logical block of ADC/DAC was described by using Verilig HDL and was verified by simulator tool. It was fabricated with Hynix 0.35um CMOS cell library. The chip size is 3700*3700um.
Therefore, in this paper presents sigma-delta ADC/DAC for audio to perform high resolution and optimal SNR. The design is fabricated with 0.35 Hynix CMOS cell library. ^[1][2]

이론/모형

In this paper, we described the sigma-delta ADC/ DAC digital block for audio. The characteristics of HBF and DSM have been simulated using Matlab tool. The logical block of ADC/DAC was described by using Verilig HDL and was verified by simulator tool.
The top block verified using NC Verilog simulator tool. Figure 4 shows a layout result.

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