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NTIS 바로가기전기전자학회논문지 = Journal of IKEEE, v.22 no.1, 2018년, pp.38 - 45
김기쁨 (Pixelplus Inc.) , 신경욱 (School of Electronic Engineering, Kumoh National Institute of Technology)
An integrated cryptographic processor that efficiently integrates ARIA, AES block ciphers and Whirlpool hash function into a single hardware architecture is described. Based on the algorithm characteristics of ARIA, AES, and Whirlpool, we optimized the design so that the hardware resources of the su...
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핵심어 | 질문 | 논문에서 추출한 답변 |
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널리 사용되는 대칭키 암호에는 어떤 것들이 있는가? | 정보보안의 가장 기본적인 요소는 인가된 (비밀키를 가지고 있는) 사용자만 내용을 확인할 수 있도록 정보를 암호화하는 기밀성이며, 이를 위해 대칭키 방식의 블록암호가 사용된다. 널리 사용되는 대칭키 암호로는 AES (Advanced Encryption Standard)[3], ARIA (Academy, Research Institute, Agency)[4] , LEA (Lightweight EncryptionAlgorithm)[5] 등이 있다. 정보보안의 또 다른 핵심 요소는 제3자에 의해 정보가 변경, 조작되지 않았음을 확인할 수 있도록 정보의 무결성을 검증하거나, 디바이스 간 인증을 통해 정당한 사용자만 접근할 수 있도록 하는 것이다. | |
RFID, 무선 센서 네트워크 (WSN)와 같은 응용 분야의 정보보안을 위해서 무엇이 필요한가? | 사물인터넷 (Internet of Things) 기술을 기반으로 하는 다양한 융합 서비스들이 활성화됨에 따라 보안 위협에 대응할 수 있는 정보보안 기술의 중요성이 부각되고 있다. 특히, RFID, 무선 센서 네트워크 (WSN)와 같이 제한된 가용 자원을 갖는 응용분야의 정보보안을 위해서는 대칭키(symmetric key) 암호와 해시 (hash) 함수 기반의 경량 하드웨어 보안 솔루션이 필요하다.[1,2] | |
ARIA는 키 길이에 따라 몇 번의 라운드 변환을 제공하는가? | ARIA [4] 는 128-비트의 평문(암호문) 블록을 암호(복호)화하여 동일한 길이의 암호문(평문)을 만드는 대칭키 방식의 블록암호 알고리듬이다. 128, 192, 256 비트의 세 가지 키 길이를 지원하며, 키 길이에 따라 12, 14, 16회의 라운드 변환을 수행하는 ISPN (Involution SPN) 구조를 갖는다. AES [3]는 2001년도 NIST에 의해 표준으로 제정된 대칭키 방식의 블록암호 알고리듬이며, non-Feistel SPN 구조를 갖는다. |
A. Whitmore, A. Anurag, and L.D. Xu, "The Internet of Things - A Survey of Topics and Trends, " Information Systems Frontiers, vol. 17, no. 2, pp. 261-274, 2015. DOI: 10.1007/s10796-014-9489-2
C. Maple, "Lightweight Cryptography Applicable to Various IoT Devices," NEC Technical Journal, vol. 12, no. 1, pp. 67-71, 2017.
Advanced Encryption Standard, NIST Standard FIPS 197, Nov. 2001.
128 bit Block Encryption Algorithm ARIA, KS X 1213:2004, 2004.
128-Bit Block Cipher LEA, TTA Standard TTAK.KO-12.0223, 2013.
Secure hash standard (SHS) , NIST Standard FIPS PUB 180-4, Mar. 2012.
P. Kitsos and O. Koufopavlou., "Whirlpool Hash Function: Architecture and VLSI Implementation," Proc. of International Symp. on Circuits and Systems, pp. 893-896, 2004. DOI: 10.1109/ISCAS.2004.1329416
Guideline on Usage for Hash Function, TTA Standard. TTAK.KO-12.0109, 2009.
K.B. Kim and K.W. Shin, "A Unified ARIA-AES Cryptographic Processor Supporting Four Modes of Operation and 128/256-bit Key Lengths," Journal of The Korea Institute of Information and Communication Engineering, vol. 21, no. 4, pp. 795-803, 2017. DOI: 10.6109/jkiice.2017.21.4.795
A. Satoh, "ASIC Hardware Implementations for 512-bit Hash Function Whirlpool," Proc. of International Symposium on Circuits and Systems, pp. 2917-2920, 2008. DOI: 10.1109/ISCAS.2008.4542068
H.K. Ahn and K.W. Shin, "AES-128/192/256 Rijndael Cryptoprocessor with On-the-fly Key Scheduler," Journal of The Institute of Electronics Engineers of Korea, vol. 39-SD, no. 11, pp. 961-971, 2002.
J. Park, Y.D. Kim, S. Yang and Y. You, "Low Power Compact Design of ARIA Block Cipher," Proc. of International Symposium on Circuits and Systems, pp. 313-316, 2006. DOI: 10.1109/ISCAS.2006.1692585
B.S. Koo, G.H. Ryu, T.J. Chang and S. Lee, "Design of an Efficient AES-ARIA Processor using Resource Sharing Technique," Journal of The Korea Institute of Information Security and Cryptology, vol. 18, no. 6A, pp. 39-49, Dec. 2008.
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