[논문]간접전류제어방식 병렬형 계통연계 인버터의 무순단 모드절환

송인종; 최준수; 임경배; 최재호

doi:10.6113/tkpe.2019.24.5.334

간접전류제어방식 병렬형 계통연계 인버터의 무순단 모드절환
Seamless Mode Transfer of Indirect Current Controlled Parallel Grid-Connected Inverters 원문보기

전력전자학회 논문지 = The Transactions of the Korean Institute of Power Electronics, v.24 no.5, 2019년, pp.334 - 341

송인종 (School of Electrical Eng., Chungbuk National University) , 최준수 (School of Electrical Eng., Chungbuk National University) , 임경배 (WooJin Industrial System Co. Ltd) , 최재호 (School of Electrical Eng., Chungbuk National University)

Abstract ▼ AI-Helper

This study proposes the control strategy for the seamless mode transfer of indirect current controlled parallel grid-connected inverters. Under the abnormal grid condition, the grid-connected inverter can convert the operation mode from grid-connected to stand-alone mode to supply power to the local load. For a seamless mode transfer, the time delay problems caused by the accumulated control variable error must be solved, and the indirect current control method has been applied as one of the solutions. In this study, the design of control parameters for the proportional-resonant-based triple-loop indirect current controller and the control strategy for the seamless mode transfer of parallel grid-connected inverters are described and analyzed. The validity of the proposed mode transfer method is verified by the PSiM simulation results.

주제어

표/그림 (24)

그림 Fig. 1. Configuration of parallel grid-connected inverters.
그림 Fig. 2. Control strategy for parallel connected inverter.
그림 Fig. 3. Control block diagram for proposed controller.
그림 Fig. 4. Sequence diagram for proposed controller.
그림 Fig. 5. Root-locus result of inner current controller.
그림 Fig. 6. Block diagram for inner current controller.
그림 Fig. 7 Block diagram for inner voltage controller.
그림 Fig. 8. Root-locus result of inner voltage controller (K_p=0).
그림 Fig. 9. Root-locus result of inner voltage controller (K_i=0).
그림 Fig. 10. Root-locus of inner voltage controller (K_p=0.0308).
그림 Fig. 11. Bode plot of voltage controller (PR controller).
그림 Fig. 12. Bode plot of voltage controller with several K_i
그림 Fig. 13. Bode plot of voltage controller with several K_p.
그림 Fig. 14. Bode plot of voltage controller with several K_cp.
그림 Fig. 17. Inverter current output of DG₁ and DG₂.
그림 Fig. 18. Inverter voltage output of DG₁.
그림 Fig. 15. Active power of total (top), DG1 and DG2 (middle), load (bottom).
그림 Fig. 16. Reactive power of total (top), DG1 and DG2 (middle), load (bottom).
그림 Fig. 19. Inverter output voltage (top) and phase angle (bottom) in GS mode.
그림 Fig. 20. Grid side inductor current (top) and load output current (bottom).
표 TABLE I SIMULATION PARAMETER
그림 Fig. 21. Inverter voltage waveforms under load change from 100% to 50%.
그림 Fig. 22. Current waveforms under load change from 100% to 50%: Grid current (top), inverter current (middle), load output current (bottom).
그림 Fig. 23. Active and reactive power of DG₁ and DG₂ under load change from 100% to 50%.

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