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재귀호출을 위한 합성 가능한 VHDL 코드 변환기 설계
Design of synthesizable VHDL transrator for recursive call 원문보기

99 가을 학술발표논문집(III) -한국정보과학회, 1999 Oct., 1999년, pp.51 - 53  

홍승완 (조선대학교 전자계산학과) ,  안성용 (조선대학교 전자계산학과) ,  이정아 (조선대학교 전자계산학과)

초록
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시스템을 설계함에 있어 시스템의 성능과 비용 및 시간을 고려한 하드웨어 소프트웨어를 혼합한 통합설계(codesign) 환경이 많아 연구되고 있다. 통합 설계 과정을 자동화하기 위해서는 기술 언어를 툴에 맞게 자동적으로 바꾸어주는 기능이 필요하게 된다. C를 VHDL로 변환하는 방법에서 특히 동적 할당, 포인터, 재귀 호출에 대한 변환이 어렵다. 본 논문은 재귀 호출 부분을 제어부, 연산부, 입력부, 메모리로 나누어 각각을 component로 설계하게 만들었다. C언어로부터 합성 가능한 VHDL로의 변환 중 재귀 호출에 관한 연구를 수행함으로써 상위 수준에서의 시스템 설계를 할 수 있도록 도와주고, C로부터 VHDL로의 변환에 유연성을 부여하여, 설계를 자동화시키는데 기여할 수 있을 것이다.

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