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ROM 사이즈 저감을 위한 DDS 설계기법 및 구현
A Design Technique to Reduce DDS ROM Size and Its Implementation 원문보기

한국해양정보통신학회 2005년도 춘계종합학술대회, v.9 no.1, 2005년, pp.1053 - 1056  

전만영 (동양대학교) ,  이행우 (남서울대학교)

초록
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본 논문에서는 ROM 사이즈를 줄이기 위한 디지털 합성기의 설계기법과 그 구현에 관하여 기술한다. 지금까지 제안된 설계기법과는 달리, 본 논문에서 제안하는 기법은 최소한의 부가적 하드웨어만을 사용하여 ROM 사이즈를 대폭 줄일 수 있다. 구현된 디지털 합성기는 입력한 주파수 제어값에 따라 원하는 발진 주파수를 정확하게 합성해내고 있음을 측정결과로부터 확인할 수 있었다.

Abstract AI-Helper 아이콘AI-Helper

This paper proposes a design technique of DDS (Direct Digital Synthesizer) to reduce the ROM size, and also describes the procedure of the implementation of the technique. Unlike other techniques suggested so far, the proposed technique is able to reduce the ROM size to a great extent with minimal h...

AI 본문요약
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문제 정의

  • 그림1의 Tienemey, Rader, Gold 구조에서는 사인함수의 1 상한에서 4 상한 값 전체를 ROM에 저장시킴으로써 ROM 사이즈가 커지고 이로 인하여 ROM의 access time의 증가와 ROM의 낭비가 심하였다. 본 연구에서는 Tienemey, Rader, Gold 구조와 동일한 주파수 분해능(같은 Word Length L)을 유지하면서도 ROM Size를 1/4로 줄이기 위하여, ROM에 사인함수의 1 상한의 값만을 저장시 키고 2, 3, 4 상한에서의 값은 이 1상 한의 값을 적절히 가공하여 출력한다. 이렇게 함으로써 ROM 사이즈를 대폭 줄일 수 있으면서도 실제적 L 값은 Tienemey, Rader, Gold 구조에서와 동일하게 유지하게 되어 ROM 사이즈의 축소에 따른 주파수 분해능의 저하를 막을 수 있다.
  • 본 연구에서는 부가적 하드웨어를 거의 필요로 하지 않으면서 ROM 사이즈를 대폭 줄일 수 있는 새로운 DDS 설계기법올 제시하고 이의 설계 과정을 기술하였다. 본 연구에서 제시된 설계기법을 사용하면 통상적 기법보다 ROM 사이즈를 1/4까지 줄일 수 있다.
  • 상기의 모든 기법은 ROM 사이즈는 줄일 수 있으나 수천 게이트 이상의 추가적 하드웨어를 필요로 하는 단점이 있다. 본 연구에서는 이러한 단점을 극복하기 위하여, 추가적 하드웨어를 거의 필요로 하지 않으면서도 ROM 사이즈를 1/4로 줄일 수 있는 DDS의 새로운 설계 기법을 제시하고 이의 구현에 관하여 서술한다.
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