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고효율 2단 인터리브 동기정류형 벅 컨버터
A High Efficient, Two-Stage Interleaved Synchronous Buck CMOS DC-DC Converter 원문보기

대한전자공학회 2008년도 하계종합학술대회, 2008 June 18, 2008년, pp.1069 - 1070  

박종하 (한양대학교 전기전자제어계측공학과) ,  김훈 (한양대학교 전기전자제어계측공학과) ,  김희준 (한양대학교 전기전자제어계측공학과)

Abstract ▼ AI-Helper 아이콘AI-Helper

This paper presents a high efficient two-stage interleaved synchronous buck CMOS DC-DC converter. The proposed circuit has a fixed duty cycle as 0.5 by an added buck converter. And it causes the best ripple cancelation of the output current ripple. The proposed circuit was simulated by HSPICE with a...

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문제 정의

  • 5에서 벗어날수록 리플 전류가 발생하게 된다. 본 논문에서는 이를 개선하기 위해 시비율을 0.5로 고정하기 위해 입력단 컨버터를 추가한 0.35㎛ CMOS 공정으로 설계된 인터리브 DC-DC 컨버터를 제안한다. 그림 1은 제안된 회로의 전체 회로도이다.
  • 본 논문은 컨버터의 출력전류의 리플을 감소시키기 위한 고효율의 인터리브 컨버터를 제안하였다. 제안된 인터리브 컨버터는 매우 적을 리플을 가지므로 노이즈에 민감한 RF 시스템에 적용 가능 할 것이다.
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