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연합인증

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CMOS 인버터 회로장치 원문보기

IPC분류정보
국가/구분 한국(KR)/등록특허
국제특허분류(IPC8판)
  • H03K-019/0175
  • H03K-019/0948
출원번호 10-2013-0124890 (2013-10-18)
공개번호 10-2015-0045566 (2015-04-29)
등록번호 10-2034903-0000 (2019-10-15)
DOI http://doi.org/10.8080/1020130124890
발명자 / 주소
  • 유범선 / 충청북도 청주시 흥덕구 향정동 * 매그나칩 반도체 유한회사 내
  • 임규호 / 충청북도 청주시 흥덕구 향정동 * 매그나칩 반도체 유한회사 내
  • 강태경 / 충청북도 청주시 흥덕구 향정동 * 매그나칩 반도체 유한회사 내
출원인 / 주소
  • 매그나칩 반도체 유한회사 / 충북 청주시 흥덕구 향정동 *
대리인 / 주소
  • 김종선; 이형석
심사청구여부 있음 (2018-04-25)
심사진행상태 등록결정(재심사후)
법적상태 등록

초록

본 발명은 CMOS 인버터 회로장치에 관한 것으로, 입력신호의 천이시에 MP0 및 MN0의 각 게이트 노드의 충전 경로 및 방전 경로를 각각 다르게 생성하는 딜레이 회로 유닛을 더 포함하고 있다. 따라서 본 발명은 입력신호의 천이시에 발생하는 단락 회로전류(short circuit current)를 최소화할 수 있거나 제거할 수 있고, 회로 구성을 간단하게 할 수 있으며 CMOS 인버터 회로장치의 크기를 작게할 수 있다.

대표청구항 ▼

게이트 단자를 통해 동일한 입력신호를 인가받고, 직렬로 각각 연결되는 MP1와 MN2 및 MP2와 MN1; 상기 MP1와 MN2의 드레인이 연결된 노드 N1에 접속된 MP0; 상기 MP2와 MN1의 드레인이 연결된 노드 N2에 접속된 MN0; 및 각각 게이트를 통해 상기 입력신호를 각각 인가받고, 드레인이 연결된 노드 N5가 상기 MN2의 소스와 상기 MP2의 소스가 연결된 노드 N4에 연결되도록 직렬 연결된 MP3 및 MN3을 구비하는 딜레이 회로 유닛을 포함하며,상기 MP0와 MN0가 동시에 턴 온 되는 것을 방지하기 위해 상기

발명자의 다른 특허 :

이 특허에 인용된 특허 (1)

  1. [미국] System and method for reducing short circuit current in a buffer | Lin, Hsiao-Ming
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