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[한국특허] 3차원(3D) NAND 메모리들을 위한 단결정질 수직 배향 실리콘 채널들을 제조하기 위한 전기-열 방법 원문보기

IPC분류정보
국가/구분 한국(KR)/공개특허
국제특허분류(IPC8판)
  • H01L-027/1157
  • H01L-021/02
  • H01L-027/11582
출원번호 10-2022-7026696 (2022-08-02)
공개번호 10-2022-0123288 (2022-09-06)
우선권정보 미국(US) 62/956,920 (2020-01-03)
국제출원번호 PCT/US2020/067637 (2020-12-31)
국제공개번호 WO 2021/138541 (2021-07-08)
번역문제출일자 2022-08-02
DOI http://doi.org/10.8080/1020227026696
발명자 / 주소
  • 아모로소, 살바토어 / 미국 ***** 캘리포니아주 마운틴 뷰 이스트 미들필드 로드 *** 시놉시스, 인크. 내
  • 모로즈, 빅토르 / 미국 ***** 캘리포니아주 마운틴 뷰 이스트 미들필드 로드 *** 시놉시스, 인크. 내
출원인 / 주소
  • 시놉시스, 인크. / 미국 ***** 캘리포니아주 마운틴 뷰 이스트 미들필드 로드 ***
대리인 / 주소
  • 양영준; 백만기
법적상태 공개

초록

다수의 수직 NAND 메모리 셀들을 형성하는 방법은, 부분적으로, 실리콘 기판(50) 상에 다수의 절연성 재료들(20, 30)을 형성하는 단계, 실리콘 기판의 표면을 노출시키도록 절연성 재료들에 트렌치를 형성하는 단계, 트렌치의 측벽들을 따라 폴리실리콘 층(70)을 퇴적하는 단계, 트렌치를 산화물(80)로 채우는 단계, 트렌치 위에 금속 층(90)을 형성하는 단계, 및 실리콘 기판과 금속 층 사이에 전압(98)을 인가하여, 폴리실리콘 측벽들이 용융되게 하고, 용융된 폴리실리콘 측벽들이 단결정질 채널로 재결정화될 수 있게 함으로써,

대표청구항

복수의 수직 NAND 메모리 셀들을 형성하는 방법으로서,실리콘 기판 상에 복수의 절연성 재료들을 형성하는 단계;상기 복수의 절연성 재료들에 트렌치를 형성하는 단계 ― 상기 트렌치는 상기 실리콘 기판의 표면을 노출시킴 ―;상기 트렌치의 측벽들을 따라 폴리실리콘 층을 퇴적하는 단계;상기 트렌치를 산화물로 채우는 단계;상기 트렌치 위에 금속 층을 형성하는 단계; 및상기 실리콘 기판과 상기 금속 층 사이에 전압을 인가하여, 폴리실리콘 측벽들이 용융되게 하고, 용융된 폴리실리콘 측벽들이 단결정질 채널로 재결정화될 수 있게 함으로써, 상기 복

이 특허에 인용된 특허 (3)

  1. [미국] Method for annealing silicon thin films and polycrystalline silicon thin films prepared therefrom | Ro,Jae Sang, Hong,Won Eui
  2. [미국] VERTICAL-TYPE SEMICONDUCTOR DEVICES AND METHODS OF MANUFACTURING THE SAME | Son, Yong-Hoon, Lee, Jong- Wook, Kang, Jong-Hyuk
  3. [미국] METHOD OF MANUFACTURING SEMICONDUCTOR DEVICE | MATSUSHITA, Daisuke, KATO, Koichi, MITAINI, Yuichiro
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