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Architecture for a flash erase EEPROM memory 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G11C-007/00
  • G11C-011/40
출원번호 US-0275380 (1988-11-23)
발명자 / 주소
  • Amin Alaaeldin (Dhahran SAX)
출원인 / 주소
  • National Semiconductor Corp. (Santa Clara CA 02)
인용정보 피인용 횟수 : 18  인용 특허 : 2

초록

An EEPROM device provides increased speed and less susceptibility to soft writes during reading and programming operations. A unique circuit design and operating method obviates the need for applying a high programming or erase voltage in the path between the memory array and sense amplifier. Such h

대표청구항

A memory device comprising: a memory cell comprising: a source region;

이 특허에 인용된 특허 (2)

  1. Baker Frank K. (Austin TX) Pfiester James R. (Austin TX) Hart Charles F. (Pflugerville TX), EPROM device using asymmetrical transistor characteristics.
  2. Iizuka Hisakazu (Yokohama JPX), Method of operating a semiconductor memory circuit.

이 특허를 인용한 특허 (18)

  1. Luk, Wing K.; Dennard, Robert H., Amplifiers using gated diodes.
  2. Luk, Wing K.; Dennard, Robert H., Amplifiers using gated diodes.
  3. Luk, Wing K.; Dennard, Robert H., Amplifiers using gated diodes.
  4. Pio Federico (Milan ITX) Riva Carlo (Milan ITX) Lucherini Silvia (Milan ITX), Circuit structure for a memory matrix and corresponding manufacturing method.
  5. Ou, Tien-Fan; Tsai, Wen-Jer; Huang, Jyun-Siang, Electrically isolated gated diode nonvolatile memory.
  6. Garcia Michel,FRX, Flat screen having individually dipole-protected microdots.
  7. Luk,Wing K.; Chang,Leland; Dennard,Robert H.; Montoye,Robert, High speed latch circuits using gated diodes.
  8. Lee Hyong-Gon,KRX, Integrated circuit memory devices having direct read capability.
  9. Ghneim Said N. ; Fulford ; Jr. H. Jim, Method of making non-volatile memory device having a floating gate with enhanced charge retention.
  10. Ghneim Said N. ; Fulford ; Jr. H. Jim, Non-volatile memory device having a floating gate with enhanced charge retention.
  11. Reddy T. Damodar ; Ray Abhijit, Nonvolatile memory array having local program load line repeaters.
  12. Roohparvar, Frankie F., Preconditioning of defective and redundant columns in a memory device.
  13. Roohparvar,Frankie F., Preconditioning of defective and redundant columns in a memory device.
  14. Lee Peter W. ; Hsu Fu-Chang ; Tsao Hsing-Ya, Reversed split-gate cell array.
  15. Lee Peter Wung ; Hsu Fu-Chang ; Tsao Hsing-Ya, Reversed split-gate cell array.
  16. Ono Takashi,JPX, Semiconductor nonvolatile memory and source circuit for this memory.
  17. Luk,Wing K.; Chang,Leland; Dennard,Robert H.; Montoye,Robert, Sense amplifier circuits and high speed latch circuits using gated diodes.
  18. LeMoncheck John (El Granada CA) Allen Timothy P. (Los Gatos CA) Steinbach Gunter (Palo Alto CA) Mead Carver A. (Pasadena CA), Writable analog reference voltage storage device.
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