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특허 상세정보

User-proof post-assembly offset voltage trim

국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판) H03F-003/45   
미국특허분류(USC) 330/261 ; 330/307
출원번호 US-0571378 (1990-08-21)
발명자 / 주소
출원인 / 주소
인용정보 피인용 횟수 : 10  인용 특허 : 0
초록

A post-assembly trim of a monolithic IC is set forth wherein selected package pins can be employed to address the on-chip trim circuit. Then, after the trim is completed, the circuit is addressed to provide a disconnect of the coupling between the trim pins and the post assembly trim circuit of the IC, while leaving the pins fully usable for other purposes. This means that following the post-assembly trim the trim pins cannot accidentally be employed for further trimming and the packaged IC is user-proof. A circuit that employs zener zapping for both tri...

대표
청구항

In a monolithic integrated circuit which includes an operational amplifier having a differential input stage that can be trimmed after final assembly, an offset voltage trim circuit comprising: means for coupling a plurality of final package pins to said trim circuit; means for generating a trim current comprising a plurality of digitally related individual trim currents; means for applying one or more of said individual trim currents in combination to said input stage; means for selecting to which side of said differential input stage said individual tr...