[특허]CMOS level shifter circuit

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IPC분류정보
국가/구분	United States(US) Patent 등록
국제특허분류(IPC7판)	H03K-019/0175 H03K-019/20
출원번호	US-0696981 (1991-05-02)
발명자 / 주소	Lee Sywe N. (Lawrenceville NJ)
출원인 / 주소	David Sarnoff Research Center, Inc. (Princeton NJ 02)
인용정보	피인용 횟수 : 19 인용 특허 : 0

초록 ▼

A level shifter circuit has a pair of voltage buses, first and second p-channel MOS transistors and third and fourth n-channel MOS transistors. Each transistor has a gate to control conduction. The first and third transistors are connected in series between the voltage buses and the second and fourth transistors are connected in series between the voltage buses. A node between the first and second transistors is connected to the gates of the second and fourth transistors. An input signal having one of first and second levels is applied to the gate of the first transistor while the inverse of the input signal is applied to the gate of the second transistor. One voltage bus is connected through one of the second and fourth transistors in response to the first level input signal. The other voltage bus is connected the other of the second and fourth transistors in response to the second level input signal.

대표청구항 ▼

A level shifter circuit comprising: a pair of voltage buses; first and second p-channel MOS transistors and third and fourth n-channel MOS transistors; each transistor having a gate to control conduction therethrough; the first and third transistors being connected in series between the pair of voltage buses; the second and fourth transistors being connected in series between the pair of voltage buses; a node between the first and third transistors being connected to the gates of the third and fourth transistors; means for applying an input signal having one of first and second levels to the gate of the first transistor; and means for applying the inverse of the input signal to the gate of the second transistor; and a node between the second and fourth transistors being coupled to one of the voltage buses through one of the second and fourth transistors in response to the first level signal and to the other of the voltage buses through the other of the second and fourth transistors in response to the second level input signal; each of the field effect transistors being a thin field effect transistor which is formed on a non-semiconductor substrate.

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Sanchez,Hector; Tang,Xinghai; Greaves,Carlos A.; Nissen,Jim P., High speed output buffer with AC-coupled level shift and DC level detection and correction.
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Hochschild,James R., Level shifter circuit including a set/reset circuit.
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Song Byoung-Cheol,KRX ; Yu Hak-Soo,KRX ; Lee Kwang-Jin,KRX, Method and apparatus for a level shifter for use in a semiconductor memory device.
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Horan, John M.; O'Donovan, Niall, Method and apparatus for level shifting approach with symmetrical resulting waveform.
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Sinha, Rohan; Rana, Vikas, Single stage cascoded voltage level shifting circuit.
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Brownlow, Michael James; Cairns, Graham Andrew; Kubota, Yasushi; Washio, Hajime, Voltage level shifter and display device.
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Michael James Brownlow GB; Graham Andrew Cairns GB; Yasushi Kubota JP; Hajime Washio JP, Voltage level shifter and display device.
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Tamaki, Takashi, Voltage level shifting circuit.
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Kim,Tae H.; Kirsch,Howard C., Voltage level shifting circuit and method.
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Menniti Pietro,ITX ; Novelli Aldo,ITX, Voltage-level shifter.
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IPC	Description
A	생활필수품
A62	인명구조; 소방(사다리 E06C)
A62B	인명구조용의 기구, 장치 또는 방법(특히 의료용에 사용되는 밸브 A61M 39/00; 특히 물에서 쓰이는 인명구조 장치 또는 방법 B63C 9/00; 잠수장비 B63C 11/00; 특히 항공기에 쓰는 것, 예. 낙하산, 투출좌석 B64D; 특히 광산에서 쓰이는 구조장치 E21F 11/00)
A62B-1/08	.. 윈치 또는 풀리에 제동기구가 있는 것

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