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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0173136 (1993-12-22) |
발명자 / 주소 |
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출원인 / 주소 |
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인용정보 | 피인용 횟수 : 66 인용 특허 : 0 |
A general purpose computer system is equipped with apparatus for enabling a processor to provide efficient execution of multiple instructions per clock cycle. The major feature is a decoded instruction cache with multiple instructions per cache line. During run time cache hits, the decode logic fill
In a general purpose computer having specialized functional units for parallel execution of instructions utilizing an instruction cache with one or more directories for parallel access to instructions issued to the functional units simultaneously, the instruction cache comprising: instruction cache
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