최소 단어 이상 선택하여야 합니다.
최대 10 단어까지만 선택 가능합니다.
다음과 같은 기능을 한번의 로그인으로 사용 할 수 있습니다.
NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
---|---|
국제특허분류(IPC7판) |
|
출원번호 | US-0269102 (1994-06-30) |
우선권정보 | JP-0160575 (1993-06-30) |
발명자 / 주소 |
|
출원인 / 주소 |
|
인용정보 | 피인용 횟수 : 16 인용 특허 : 0 |
Logic synthesis device for LSI having a configuration divided into a plurality of hierarchical blocks specified by hierarchical design comprises a logic synthesis section which uses the logic description information describing the logic operation contents for each of the hierarchical blocks, informa
A logic synthesis method for LSI having a configuration divided into a plurality of hierarchical blocks specified by hierarchical design, logic description information in a certain design description language describing the logic operation contents of said LSI for each of said hierarchical blocks, a
※ AI-Helper는 부적절한 답변을 할 수 있습니다.