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FPGA with a plurality of I/O voltage levels 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-019/0948
출원번호 US-0837023 (1997-04-11)
발명자 / 주소
  • Goetting F. Erich
  • Frake Scott O.
  • Kondapalli Venu M.
  • Young Steven P.
출원인 / 주소
  • Xilinx, Inc.
대리인 / 주소
    Cartier
인용정보 피인용 횟수 : 34  인용 특허 : 9

초록 ▼

The invention comprises an FPGA having a plurality of input reference voltages and/or output voltage supplies. In one embodiment, two or more differential amplifiers in the same configurable input buffer use different input reference voltages. According to a second aspect of the invention, the I/O p

대표청구항 ▼

[ What is claimed is:] [1.] An Input/Output Block (IOB), comprising:an input reference voltage line;an input/output pad connected to a pad line;an input buffer having said pad line as an input, said input buffer comprising a differential amplifier, said differential amplifier having a reference inpu

이 특허에 인용된 특허 (9)

  1. Farhang Ali R. (Beaverton OR) Nogle Scott G. (Austin TX), Buffer circuit having variable output impedance.
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  2. Assar Mahmud (Morgan Hill CA) Agarwal Prakash C. (San Jose CA) Bril Vlad (Campbell CA), CMOS low power mixed voltage bidirectional I/O buffer.
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  3. Lee Napoleon W. ; Curd Derek R., Configurable performance-optimized programmable logic device.
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  4. Yao Chingchi (Saratoga CA) Wang Poucheng (Mt. View CA), Efficient method and resulting structure for integrated circuits with flexible I/O interface and power supply voltages.
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  5. Nakase Yasunobu,JPX, Input circuit.
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  6. Dryer Stephen F. ; Hu Rong-Hui, Integrated circuit I/O node useable for configuration input at reset and normal output at other times.
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  7. Iwamura Masahiro (Hitachi JPX) Maejima Hideo (Hitachi JPX) Masuda Ikuro (Hitachi JPX), Logic circuit and semiconductor integrated circuit device capable of operating by different power supplies.
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  8. Becker Steffen (Zorneding DEX) Schmitt-Landsiedel Doris (Ottobrunn DEX) Keitel-Schulz Doris (Munich DEX), Programmable logic array having programmable output driver drive capacity.
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  9. Hsieh Hung-Cheng (Sunnyvale CA), TTL/CMOS compatible input buffer with Schmitt trigger.
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이 특허를 인용한 특허 (34)

  1. Kao,Oliver C., Apparatus and method for implementing an analog-to-digital converter in programmable logic devices.
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  2. Ralph T. Luna ; Lloyd F. Linder ; Erick M. Hirata, Apparatus for translating digital signals.
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  3. Lesea, Austin H.; Ghia, Atul V., Asymmetric bidirectional bus implemented using an I/O device with a digitally controlled impedance.
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  4. Rahman, Arifur; Andrews, William; Lin, Mou C., Bank-based input/output buffers with multiple reference voltages.
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  5. Alexander, Mark A.; Lesea, Austin H., Bi-directional interface and communication link.
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  6. Shekhar Bapat ; Lawrence C. Hung, Deskewing clock signals for off-chip devices.
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  7. Lesea,Austin H.; Wu,Yiding, Duty cycle characterization and adjustment.
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  8. Sewani, Aman; Upadhyaya, Parag, Input/output circuits and methods of implementing an input/output circuit.
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  9. Lee, Jung-bae, Memory module capable of improving the integrity of signals transmitted through a data bus and a command/address bus, and a memory system including the same.
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  10. Anderson, Jason H.; Saunders, James L.; Chari, Madabhushi V. R.; Nag, Sudip K.; Jayaraman, Rajeev, Method and apparatus for placement of input-output design objects into a programmable gate array.
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  11. Bhattacharya,Subhrajit; Darringer,John; Ostapko,Daniel L., Method for using partitioned masks to build a chip.
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  12. William B. Andrews ; Harold N. Scholz, Multi-functional I/O buffers in a field programmable gate array (FPGA).
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  13. Wang, Xiaobao; Sung, Chiakang; Nguyen, Khai; Huang, Joseph; Wang, Bonnie; Pan, Philip; Chong, Yan; Kim, In Whan; Rangan, Gopinath; Chang, Tzung-Chin, On/off reference voltage switch for multiple I/O standards.
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  14. Clark, Lawrence T.; Mozdzen, Thomas J., Output buffer for high and low voltage bus.
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  15. Philip Alan Jeffery ; Shilpa Rao, Pin programmable reference.
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  16. Anderson Jason H. ; Saunders James L. ; Chari Madabhushi V. R. ; Nag Sudip K. ; Jayaraman Rajeev, Placement of input-output design objects into a programmable gate array supporting multiple voltage standards.
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  17. Masleid, Robert Paul, Power efficient multiplexer.
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  18. Masleid, Robert Paul, Power efficient multiplexer.
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  19. Masleid, Robert Paul, Power efficient multiplexer.
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  20. Masleid, Robert Paul, Power efficient multiplexer.
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  21. Wang, Bonnie I.; Sung, Chiakang; Huang, Joseph; Nguyen, Khai Q.; Pan, Philip Y., Programmable high-speed I/O interface.
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  22. Wang, Bonnie I.; Sung, Chiakang; Huang, Joseph; Nguyen, Khai Q.; Pan, Philip Y., Programmable high-speed I/O interface.
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  23. Wang, Bonnie I.; Sung, Chiakang; Huang, Joseph; Nguyen, Khai; Pan, Philip, Programmable high-speed interface.
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  24. Menon Suresh Manohar ; Bobra Yogendra Kumar ; Ghia Atul V. ; Zaliznyak Arch, Programmable input/output circuit for FPGA for use in TTL, GTL, GTLP, LVPECL and LVDS circuits.
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  25. Kerry Veenstra ; Krishna Rangasayee ; John E. Turner, Programmable logic device input/output architecture with power bus segmentation for multiple I/O standards.
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  26. Wayne Yeung ; Chiakang Sung ; Myron W. Wong ; Khai Nguyen ; Bonnie I. Wang ; Xiaobao Wang ; Joseph Huang ; Im Whan Kim, Programmable logic device input/output circuit configurable as reference voltage input circuit.
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  27. Wayne Yeung ; Chiakang Sung ; Myron W. Wong ; Khai Nguyen ; Bonnie I. Wang ; Xiaobao Wang ; Joseph Huang ; In Whan Kim, Programmable logic device input/output circuit configurable as reference voltage input circuit.
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  28. El-Ayat, Khaled A., Programmable multi-standard I/O architecture for FPGAS.
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  29. Austin H. Lesea, Realizing analog-to-digital converter on a digital programmable integrated circuit.
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  30. Lesea Austin H., Realizing analog-to-digital converter on a digital programmable integrated circuit.
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  31. Agrawal,Om P.; Nguyen,Bai; Chi,Kuang; Sharpe Geisler,Brad; Tran,Giap, Scalable serializer-deserializer architecture and programmable interface.
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  32. Verma,Himanshu J.; Oh,Kwansuhk, Signal adjustment for duty cycle control.
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  33. Cical, Ionut C.; Cullen, Edward; Bogue, Ivan, System and method of eliminating on-board calibration resistor for on-die termination.
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  34. Bhattacharya, Subhrajit; Darringer, John; Ostapko, Daniel L., System for using partitioned masks to build a chip.
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