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[미국특허] Highly parallel cyclic redundancy code generator 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03M-013/00
출원번호 US-0540145 (1995-10-06)
발명자 / 주소
  • Maa Chia-Yiu
출원인 / 주소
  • Tektronix, Inc.
대리인 / 주소
    Gray
인용정보 피인용 횟수 : 39  인용 특허 : 12

초록 ▼

A highly parallel cyclic redundancy code generator has p precalculated k-bit remainder polynomials loaded in a lookup table. A cyclic redundancy code register has a p-bit portion and a k-bit portion. An input data message is input to an input XOR gate together with the contents of the p-bit portion

대표청구항 ▼

[ What is claimed is:] [1.] A highly parallel cyclic redundancy code generator comprising:means for storing p predetermined remainder polynomials of k bits each, where p is the number of bits to be processed in parallel and k is the degree of the polynomial;a register having a p-bit portion and a k-

이 특허에 인용된 특허 (12) 인용/피인용 타임라인 분석

  1. Dravida Subrahmanyam (Toms River NJ), Apparatus and method for parallel generation of cyclic redundancy check (CRC) codes.
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  2. Joshi Sunil P. (Campbell CA) Iyer Venkatraman (Berkeley CA), CRC calculation machine with variable bit boundary.
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  3. Li Shiping (Canton MA) Pasco-Anderson James A. (Needham MA), Efficient CRC remainder coefficient generation and checking device and method.
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  4. Levy Howard L. (Austin TX) Schorn Eric B. (Austin TX), Fast, low power exclusive or circuit.
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  5. Shih Hubert (Adelphi MD) Kroeger Brian W. (Ellicott City MD) Delcoco Robert J. (Columbia MD), High speed parallel CRC device for concatenated data frames.
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  6. Ish-Shalom Ariel (Tel-Aviv ILX), Implementation of the HDLC CRC calculation.
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  7. Takano Masahiro (Minamiashigara JPX), Method and apparatus for CRC computation.
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  8. Douglas Phillip N. (2409 Doran Pl. Raleigh NC 27604) Johnson Alan G. (3005 Beane Dr. Raleigh NC 27604), Multiple phase CRC generator.
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  9. Fossey Craig R. (Scottsdale AZ), Parallel cyclic redundancy check circuit.
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  10. Gibbs Vickie L. (Durham NC) Kao Rom-Shen (Durham NC), Parallel encoding apparatus and method implementing cyclic redundancy check and Reed-Solomon codes.
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  11. Irvin David R. (Raleigh NC) Sy Kian-Bon (Cary NC), Preservation of CRC integrity upon intentional data alteration during message transmission.
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  12. Avaneas Napolean G. (Kings Park NY), Very high speed error detection network.
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이 특허를 인용한 특허 (39) 인용/피인용 타임라인 분석

  1. Richard, Elizabeth Anne, Adding known data to CRC processing without increased processing time.
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  2. Yoshida, Takao; Okamoto, Minoru; Yamasaki, Masayuki; Okabayashi, Kazuhiro, CRC operation unit and CRC operation method.
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  3. Derby, Jeffrey Haskell, Computing the CRC bits at a time for data whose length in bits is not a multiple of M.
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  4. Nishimura Hiroshi,JPX, Digital data error detection and correction system.
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  5. Engberg, Bjorn, Distributed checksum computation.
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  6. Zhang, Hongyuan; Srinivasa, Sudhir, Error detection in a signal field of a WLAN frame header.
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  7. Zhang, Hongyuan, Extended guard interval for outdoor WLAN.
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  8. Keller, Richard B., Fast cyclic redundancy check (CRC) generation.
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  9. Keller,Richard B., Fast cyclic redundancy check (CRC) generation.
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  10. Bain,Peter, Fast parallel calculation of cyclic redundancy checks.
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  11. Cooper, John F., Interleaved parallel redundancy check calculation for memory devices.
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  12. Poeppleman Alan D. ; Rutherford Mark D., Method and apparatus for calculating a CRC remainder.
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  13. Sydir,Jaroslaw J.; Mathur,Alok J; Feghali,Wajdi; Koshy,Kamal J.; Lecha,Eduard, Method and apparatus for calculating cyclic redundancy check (CRC) on data using a programmable CRC engine.
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  14. Bain,Peter, Method and apparatus for calculating cyclic redundancy checks for variable length packets.
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  15. Bain, Peter, Method and apparatus for concurrent calculation of cyclic redundancy checks.
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  16. Dravida Subrahmanyam ; Ravikumar Srinivasan S., Method and apparatus for generating cyclical redundancy code.
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  17. Kevin Gerard Plotz ; Albert Alfonse Slane, Method and apparatus for implementing cyclic redundancy check calculation for data communications.
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  18. Apisdorf, Joel Z., Method and apparatus for performing error checking in a network.
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  19. Anderson, Richard E.; Georgiou, Christos John; Sandon, Peter A., Method of computing partial CRCS.
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  20. Anderson, Richard E.; Georgiou, Christos John; Sandon, Peter A., Method of computing partial CRCs.
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  21. Anderson,Richard E.; Georgiou,Christos John; Sandon,Peter A., Method of computing partial CRCs.
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  22. Englert, Eric; Marchand, Bernard; Pillar, John F., Method of offloading cyclic redundancy check on portions of a packet.
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  23. Chen, Hong-Ching, Methods and apparatuses for generating error correction codes.
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  24. Chen,Hong Ching, Methods and systems for generating error correction codes.
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  25. Joel Apisdorf ; Keith Burden, Multi-protocol monitor.
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  26. Lin,Ming i M.; Connolly,Brian J.; Leonard,Todd E.; Mann,Gregory J.; Raymond,Jonathan H., Multilevel parallel CRC generation and checking circuit.
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  27. Morsberger, Gerd, Parallel CRC generation circuit for generating a CRC code.
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  28. Duvvuru, Ramesh, Parallel byte processing engines shared among multiple data channels.
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  29. Tsai,Kovsky T. J.; Chang,Joe, Parallelized CRC calculation method and system.
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  30. Zhang, Hongyuan, Physical layer frame format for WLAN.
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  31. Zhang, Hongyuan; Srinivasa, Sudhir; Nabar, Rohit U.; Banerjea, Raja, Physical layer frame format for WLAN.
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  32. Zhang, Hongyuan; Sun, Yakun; Xu, Mingguang, Physical layer frame format for WLAN.
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  33. Zhang, Hongyuan; Xu, Mingguang; Sun, Yakun, Physical layer frame format for WLAN.
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  34. Zhang, Hongyuan; Lou, Hui-Ling; Yong, Su Khiong, Range extension mode for WiFi.
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  35. Leonard,Todd E.; Mann,Gregory J., Scalable cyclic redundancy check circuit.
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  36. Mukund, Shridhar; Mahajan, Manish; Srirambhatla, Vasantha; Rao, T.V.P. Kameswar; Mitra, Anjan, Separable cyclic redundancy check.
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  37. Ferguson, Dennis C.; Chen, Devereaux C.; Padmanabhan, Ramesh; Wu, Chang-Hong; Skibo, Thomas Michael, Single cycle cyclic redundancy checker/generator.
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  38. Christopher L. Canestaro ; John Steven Langford ; Rick Allen Hamilton, II, System and method for updating microcode stored in a non-volatile memory.
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  39. Cavanna, Vicent V.; Thaler, Patricia A., System for computing a CRC value by processing a data message a word at a time.
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