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Etch stop for use in etching of silicon oxide 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-023/58
출원번호 US-0850461 (1997-05-05)
발명자 / 주소
  • Cathey David A.
  • Rolfson J. Brett
  • Ward Valerie A.
  • Winchester Karen M.
출원인 / 주소
  • Micron Technology, Inc.
대리인 / 주소
    Fletcher, Yoder & Van Someren
인용정보 피인용 횟수 : 6  인용 특허 : 9

초록

A etch stop layer for use in a silicon oxide dry fluorine etch process is made of silicon nitride with hydrogen incorporated in it either in the form of N--H bonds, O--H bonds, or entrapped free hydrogen. The etch stop layer is made by either increasing the NH.sub.3 flow, decreasing the SiH.sub.4 fl

대표청구항

[ What is claimed is:] [1.] An integrated circuit comprising:a substrate;a layer of hydrogenated silicon nitride disposed on the substrate, wherein the layer of hydrogenated silicon nitride comprises entrapped hydrogen in a concentration of greater than 1.times.10.sup.15 atoms per cubic centimeter;

이 특허에 인용된 특허 (9)

  1. Tam Gordon (Chandler AZ) Legge Ronald N. (Scottsdale AZ) Paulson Wayne M. (Austin TX), Differential etching of silicon nitride.
  2. Armacost Michael D. (Wallkill NY) Dobuzinsky David (Hopewell Junction NY) Gambino Jeffrey (Gaylordsville CT) Nguyen Son (Hopewell Junction NY), High density selective SiO2:Si3N4 etching using a stoichiometrically altered n.
  3. Toshima Masato (Sunnyvale CA) Wong Jerry (Fremont CA), Hydrogen evolution analyzer.
  4. Schuermeyer Fritz L. (Yellow Springs OH), Method of making self-aligned IGFET.
  5. Hayakawa Takashi (Nara JPX) Narikawa Shiro (Kashihara JPX) Ohashi Kunio (Nara JPX) Tsujimoto Yoshiharu (Yamatokoriyama JPX), Photosensitive member for electrophotography and process for making using electron cyclotron resonance.
  6. Logan Joseph S. (Poughkeepsie NY) Mauer ; IV John L. (Sherman CT) Rothman Laura B. (Sherman CT) Schwartz Geraldine C. (Poughkeepsie NY) Standley Charles L. (Wappingers Falls NY), Planar multi-level metal process with built-in etch stop.
  7. Nakahigashi Takahiro (Kyoto JPX) Murakami Hiroshi (Kyoto JPX) Otani Satoshi (Osaka JPX) Tabata Takao (Kyoto JPX) Maeda Hiroshi (Kyoto JPX) Kirimura Hiroya (Kyoto JPX) Kuwahara Hajime (Kyoto JPX), Plasma-CVD method and apparatus.
  8. Yamamoto Hiroshi (Suwa JPX), Semiconductor device having a passivation layer with silicon nitride layers.
  9. Huang Richard J. (Milpitas CA) Hui Angela (Milpitas CA) Cheung Robin (Cupertino CA) Chang Mark (Los Altos CA) Lin Ming-Ren (Cupertino CA), Simplified dual damascene process for multi-level metallization and interconnection structure.

이 특허를 인용한 특허 (6)

  1. Cathey David A. ; Rolfson J. Brett ; Ward Valerie A. ; Winchester Karen M., Etch stop for use in etching of silicon oxide.
  2. Cathey, David A.; Rolfson, J. Brett; Ward, Valerie A.; Winchester, Karen M., Etch stop for use in etching of silicon oxide.
  3. Effiong Ibok, Method for fabricating high permitivity dielectric stacks having low buffer oxide.
  4. Chen Cheng Chou TW; Tzong-Sheng Chang TW, Method of forming and etching a resist protect oxide layer including end-point etch.
  5. Kim, Young-Wug; Kim, Byung-Sun; Kang, Hee-Sung; Ko, Young-Gun; Park, Sung-Bae; Kim, Min-Su; Kim, Kwang-Il, SOI semiconductor integrated circuit for eliminating floating body effects in SOI MOSFETs and method of fabricating the same.
  6. Kim, Young-Wug; Kim, Byung-Sun; Kang, Hee-Sung; Ko, Young-Gun; Park, Sung-Dae; Kim, Min-Su; Kim, Kwang-Il, SOI semiconductor integrated circuit for eliminating floating body effects in SOI MOSFETs and method of fabricating the same.

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