[특허]Personal computer system incorporating an isochronous multi-channel, multi-rate data bus

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IPC분류정보
국가/구분	United States(US) Patent 등록
국제특허분류(IPC7판)	G06F-013/00 H04L-012/50
출원번호	US-0098642 (1998-06-17)
발명자 / 주소	Gulick Dale E.
출원인 / 주소	Advanced Micro Devices, Inc.
대리인 / 주소	Conley, Rose & Tayon, PCKivlin
인용정보	피인용 횟수 : 2 인용 특허 : 22

초록 ▼

An isochronous bus may includes a data signal, a data valid signal, a frame synch signal and a clock signal. The bandwidth of the data signal is partitioned into a plurality of frames. The frame rate may be selected based upon the sample rate of one of the isochronous devices connected to the isochronous bus or maybe some divisor of the data rate of the isochronous bus. Each frame is partitioned into a plurality of data channels. Each data channel transmits data from an isochronous device. A number of bit time slots are allocated to each data channel. The number of bit time slots allocated to each data channel varies based upon the sample rate of the device corresponding to the data channel. In one embodiment, each data channel is allocated more bit time slots than the nominal samples of its corresponding device. In this manner, any drift of the sample clock may be accommodated. A data valid signal is transmitted synchronous to the data signal and the clock signal. The data valid signal indicates which bit time slots include valid data. As discussed above, a data channel may be allocated more bit time slots than the expected number of samples during a frame. The system may handle multiple isochronous data streams with different, non-related sample rates.

대표청구항 ▼

[ What is claimed is:] [14.] A computer system comprising:a processor;a first bus interface unit coupled to said processor;a memory coupled to said first bus interface unit;a mezzanine bus coupled to said first bus interface unit;a second bus interface unit coupled between said mezzanine bus and a peripheral bus;an isochronous data port coupled to said first bus interface unit;a plurality of isochronous devices coupled to said isochronous data port, wherein said plurality of devices have independent sample rates, wherein said independent sample rates are synchronized to sample clocks; andan isochronous bus coupled between said isochronous data port and said first bus interface unit;wherein said isochronous data port is configured to acquire data from said plurality of isochronous devices and to output frames of time-dependent data on said isochronous data bus;wherein a first frame is partitioned into a plurality of data channels, wherein each data channel corresponds to one of said plurality of isochronous devices; andwherein each of said plurality of data channels corresponding to said plurality of isochronous devices is partitioned into a plurality of bit time slots, wherein a number of bit time slots allocated to said each data channel is the sum of a number of samples of said isochronous device corresponding to said data channel during a period of said each frame and a number of time slots necessary to accommodate drift of the sample clocks.

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A62B-1/08	.. 윈치 또는 풀리에 제동기구가 있는 것

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