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Apparatus and method for improving ball joints in semiconductor packages 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/44
출원번호 US-0406308 (1999-09-27)
발명자 / 주소
  • Patel Sunil A.
  • Chia Chok J.
  • Desai Kishor V.
출원인 / 주소
  • LSI Logic Corporation
인용정보 피인용 횟수 : 14  인용 특허 : 10

초록

Provided is an apparatus and method for modifying the manufacture of chip carrier bond pads to increase the quality and reliability of semiconductor packages and ball joints in particular. This is accomplished by minimizing the corrosion of the barrier metal layer on the functional bond pads during

대표청구항

[ What is claimed is:] [1.]1. A method for producing a semiconductor package comprising:forming a plurality of bond pads on a packaging substrate;forming a plurality of sacrificial pads on said substrate wherein said sacrificial pads do not electrically connect metallization on said packaging substr

이 특허에 인용된 특허 (10)

  1. Hoffman Paul R., Ball grid array electronic package standoff design.
  2. Schueller Randolph D., Chip scale ball grid array for integrated circuit packaging.
  3. Lake Rickie C. ; Tuttle Mark E., Electronic circuit bonding interconnect component and flip chip interconnect bond.
  4. Fulcher Edwin (Palo Alto CA), Flip chip package with reduced number of package layers.
  5. McCormick John P. ; Patel Sunil A., Integrated heat spreader/stiffener with apertures for semiconductor package.
  6. Yanagida Toshiharu,JPX, Method and apparatus for forming solder bumps for a semiconductor device.
  7. Erickson Curt A, Process for converting a wire bond pad to a flip chip solder bump pad and pad formed thereby.
  8. Wood Alan G. (Boise ID) Doan Trung T. (Boise ID) Farnworth Warren M. (Nampa ID) Corbett Tim J. (Boise ID), Process for forming a raised portion on a projecting contact for electrical testing of a semiconductor.
  9. Chia Chok J. ; Low Qwai H. ; Alagaratnam Maniam, Semiconductor die having sacrificial bond pads for die test.
  10. Mis Joseph Daniel ; Adema Gretchen Maerker ; Kellam Mark D. ; Rogers W. Boyd, Solder bump fabrication methods and structure including a titanium barrier layer.

이 특허를 인용한 특허 (14)

  1. Mohammad Eslamy, Apparatus and method for mounting BGA devices.
  2. Chen, Chih-Shun; Yuan, Po-Hao; Chiu, Shih-Kuang; Chien, Feng-Lung; Yang, Ke-Chuan, Flip-chip bumbing method for fabricating solder bumps on semiconductor wafer.
  3. Burrell,Lloyd G.; Davis,Charles R.; Goldblatt,Ronald D.; Landers,William F.; Mehta,Sanjay C., Method of fabricating a wire bond pad with Ni/Au metallization.
  4. Kaneko, Kentaro; Omiya, Toshimitsu; Kodani, Kotaro; Nakamura, Junichi; Kobayashi, Kazuhiro, Method of manufacturing a wiring substrate.
  5. Smoak, Richard C., Method to improve the reliability of thermosonic gold to aluminum wire bonds.
  6. Chiou, Wen-Chih; Shih, Tsu, Reduction of metal corrosion in semiconductor devices.
  7. Kim, Joon Su; Park, Jung Soo; Hwang, Tae Kyung, Semiconductor device and fabricating method thereof.
  8. Pendse, Rajendra D., Semiconductor wafer and method of forming sacrificial bump pad for wafer probing during wafer sort test.
  9. Zhang, Leilei, Solder ball assembly for a semiconductor device and method of fabricating same.
  10. Zhang,Leilei, Solder ball assembly for a semiconductor device and method of fabricating same.
  11. Test, Howard R.; Amador, Gonzalo; Subido, Willmar E., Wire bonding process for copper-metallized integrated circuits.
  12. Kaneko, Kentaro, Wiring board and method of producing the same.
  13. Kaneko, Kentaro, Wiring board and method of producing the same.
  14. Kaneko, Kentaro; Omiya, Toshimitsu; Kodani, Kotaro; Nakamura, Junichi; Kobayashi, Kazuhiro, Wiring substrate and method of manufacturing the same.
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