[특허]Set of two memories on the same monolithic integrated circuit

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Set of two memories on the same monolithic integrated circuit 원문보기

IPC분류정보
국가/구분	United States(US) Patent 등록
국제특허분류(IPC7판)	G11C-007/00
출원번호	US-0746473 (2000-12-21)
우선권정보	FR-0004285 (1997-04-08)
발명자 / 주소	Alessandro Brigati IT Jean Devin FR Bruno Leconte FR
출원인 / 주소	SGS-Thomson Microelectronics S.A. FR
대리인 / 주소	Wolf, Greenfield & Sacks, P.C.
인용정보	피인용 횟수 : 0 인용 특허 : 12

초록 ▼

Two different types of memory are integrated on the same type of integrated circuit. A microcontroller is associated with each of these memories. In order that the independence of operation of these microcontrollers may be ensured, they are each provided with time delay circuits whose role is to mai

대표청구항 ▼

1. A method of performing one of a reading and a writing operation on first and second memories in an integrated circuit comprising the acts of:(A) selecting one of a reading and writing operation for the first memory; (B) enabling the first memory to execute the operation selected in step (A) for a predetermined period of time greater than or equal to a duration of the operation selected in step (A); (C) selecting one of a reading and writing operation for the second memory before the predetermined period of time has ended; and (D) enabling the second memory to execute the operation selected in step (C) for a second predetermined period of time greater than or equal to a duration of the operation selected in step (C).

이 특허에 인용된 특허 (12)

Idleman Thomas E. ; Koontz Robert S., Data storage system and method.
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Ludwig Thomas E. (Irvine CA), High speed/low overhead bus arbitration apparatus and method for arbitrating a system bus.
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Chau Vi ; Berman Stuart ; Fiacco Peter, Linked caches memory for storing units of information.
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Kametani Masatsugu (Ibaraki JPX), Memory device including DRAMs for high-speed accessing.
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Saito Mitsuo (Arlington MA) Aikawa Takeshi (Chofu JPX) Mori Akio (Tokyo JPX), Memory system.
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Wagner Steven D. (Belmont CA), Method and apparatus for buffering a user application from the timing requirements of a DRAM.
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Letham Lawrence, Non-contiguous memory location addressing scheme.
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Dewey Matthew C. ; Jones Ellen F., Quick recovery of write cache in a fault tolerant I/O system.
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Brigati Alessandro,FRX ; Devin Jean,FRX ; Leconte Bruno,FRX, Set of two memories on the same monolithic integrated circuit.
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Fava Thomas F. ; Keith Joseph M. ; Fuller Randy R., Simultaneous, mirror write cache.
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Tatsuki Noboru (Tokyo JPX) Funae Hideaki (Tokyo JPX), Time slot switching function diagnostic system.
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Fant Karl M. (Minneapolis MN), Two axis fast access memory.
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관련 콘텐츠

특허 원문 보기

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IPC 상위 출원인

특허정보
IPC	Description
A	생활필수품
A62	인명구조; 소방(사다리 E06C)
A62B	인명구조용의 기구, 장치 또는 방법(특히 의료용에 사용되는 밸브 A61M 39/00; 특히 물에서 쓰이는 인명구조 장치 또는 방법 B63C 9/00; 잠수장비 B63C 11/00; 특히 항공기에 쓰는 것, 예. 낙하산, 투출좌석 B64D; 특히 광산에서 쓰이는 구조장치 E21F 11/00)
A62B-1/08	.. 윈치 또는 풀리에 제동기구가 있는 것

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