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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0949276 (2001-09-07) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 15 인용 특허 : 2 |
An improved manufacturing process and an improved device made by the process for forming via interconnects between metal layers in a multilevel metallization structure substantially eliminates trench formation during via overetch and exploding vias during via fill. An insulating multilayer structure
1. An integrated circuit manufacturing process for fabricating a borderless via for interconnecting a first bottom metal line to a second top metal line in a multilevel metallization structure on a semiconductor substrate, said first bottom metal line having a top conducting surface, comprising the
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