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특허 상세정보

FIFO buffers receiving data from different serial links and removing unit of data from each buffer based on previous calcuations accounting for trace length differences

특허상세정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판) G06F-013/00    G06F-015/76   
미국특허분류(USC) 710/029; 710/033; 710/052; 710/053; 710/131; 370/401; 370/419; 370/428; 370/429
출원번호 US-0295680 (1999-04-21)
발명자 / 주소
출원인 / 주소
대리인 / 주소
    Blakely, Sokoloff, Taylor & Zafman LLP
인용정보 피인용 횟수 : 16  인용 특허 : 3
초록

A communication interface is described to align at a destination data transmitted through different channels before that data is read out. The communication interface includes a receiver circuit that has a plurality of buffers. Each buffer is coupled to a corresponding channel to receive data therethrough. The communication interface also includes a control circuit, coupled to the plurality of buffers, to enable reading of data from the plurality of buffers when each of the plurality of buffers has received at least one unit of data.

대표
청구항

A communication interface is described to align at a destination data transmitted through different channels before that data is read out. The communication interface includes a receiver circuit that has a plurality of buffers. Each buffer is coupled to a corresponding channel to receive data therethrough. The communication interface also includes a control circuit, coupled to the plurality of buffers, to enable reading of data from the plurality of buffers when each of the plurality of buffers has received at least one unit of data. 1. A method for usin...

이 특허를 인용한 특허 피인용횟수: 16

  1. Tseng,Wayne. Circuit and method for aligning transmitted data by adjusting transmission timing for a plurality of lanes. USP2007057225354.
  2. Tseng,Wayne. Circuit and method for aligning transmitted data by adjusting transmission timing for plurality of lanes. USP2008037346798.
  3. Tanaka, Nobuyoshi; Namura, Ken. Data processing system and multiprocessor system. USP2004116813706.
  4. Sanville, Alex J.; Sardella, Steven D.. Data storage systems having seamless software upgrades. USP2013018352661.
  5. Ramankutty, Rajesh; Velandy, Rajesh; Puthiyandyil, Sanil Kumar. Methods and systems for accounting in an access gateway. USP2013118588240.
  6. Duan, Chunjie; Bhatti, Ghulam; Parsons, Kieran; Koguchi, Kazuumi; Kametani, Soichiro. Optical channel data unit switch with distributed control. USP2016019246748.
  7. Moyal, Yehuda; Levi, Yehezkel. Synchronization and alignment of multiple variable length cell streams. USP2004126834058.
  8. Xue,Ning. Synchronization and channel deskewing circuitry for multi-channel serial links. USP2008117454537.
  9. West, Michael G.; LeVasseur, Jamie J.. System and method for aligning multi-channel coded data over multiple clock periods. USP2005076917366.
  10. Dougherty,David Thomas; Clovis,Philip Michael. System and method for switch timing synchronization. USP2006027002996.
  11. Wu, Ephrem C.; Liu, Ye; Zhong, Freeman V.. System for automatic bandwidth control of equalizer adaptation loops. USP2010107813415.
  12. Chuang, Ying-Ting; Chen, Kuo-Kuang. Time aligning circuit and time aligning method for aligning data transmission timing of a plurality of lanes. USP2013018352773.
  13. Tan, Pek Yew. Time based multimedia objects streaming apparatus and method. USP2005076917984.
  14. Tan, Pek Yew; Ng, Kok Leong. Time based multimedia objects streaming apparatus and method. USP2005106954796.
  15. S철nning,Raimund; Huaman Bollo,Gian. Time-alignment apparatus and method for providing data frames of a plurality of channels with predeterminated time-offsets. USP2006107126967.
  16. Sönning, Raimund; Huaman-Bollo, Gian. Time-alignment apparatus and method for providing data frames of a plurality of channels with predetermined time-offsets. USP2004086781976.