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[미국특허] Method for hermetic leadless device interconnect using a submount 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01B-017/26
  • H01H-001/02
  • H01L-021/30
  • H01L-029/40
출원번호 US-0513634 (2000-02-28)
발명자 / 주소
  • Zolnowski, Dennis Ronald
출원인 / 주소
  • Agere Systems Inc.
대리인 / 주소
    Lowenstein Sandler PLC
인용정보 피인용 횟수 : 5  인용 특허 : 24

초록

In accordance with the invention, a semiconductor device having an electrical input/output contact surface is hermetically sealed and provided with connections via a submount such as a two-level ceramic substrate. The device is provided with a contact surface having a sealable peripheral contact and

대표청구항

1. A method of hermetically sealing and providing with electrical connections a semiconductor device having an electrical input/output contact surface including at least one contact in a region to be sealed comprising the steps of: providing the device with a sealable peripheral contact around th

이 특허에 인용된 특허 (24) 인용/피인용 타임라인 분석

  1. Tokuda Masahide,JPX ; Kato Takeshi,JPX ; Itoh Hiroyuki,JPX ; Yagyu Masayoshi,JPX ; Fujita Yuuji,JPX ; Usami Mitsuo,JPX, Chip connection structure having diret through-hole connections through adhesive film and wiring substrate.
  2. Yamaguchi Kouichi,JPX ; Hamada Noriaki,JPX ; Yonekura Hideto,JPX ; Kubota Takeshi,JPX ; Kunimatsu Yasuyoshi,JPX ; Tami Yasuhide,JPX ; Higashi Masahiko,JPX ; Furukubo Yohji,JPX, Circuit board.
  3. Katz Avishay (Westfield NJ) Lee Chien-Hsun (North Plainfield NJ) Tai King L. (Berkeley Heights NJ), Debondable metallic bonding method.
  4. Bloom Terry R. (Middlebury IN), Electrically conductive, hermetic vias and their use in high temperature chip packages.
  5. Chason Marc K. (Schaumburg IL) Kotecki Carl A. (Palatine IL) Tomase Joseph P. (Libertyville IL) Onystok Michael J. (Bloomingdale IL) Ryback Donald J. (Northbrook IL) Kinsman Robert G. (Naperville IL), Electrostatically sealed piezoelectric device.
  6. Zhang Xia ; McIntyre David G. ; Tang William Chi-Keung, Fabrication method for encapsulated micromachined structures.
  7. Lischner David ; Nika Raymond J. ; Ronemus James Robert, Heatspreader for a flip chip device, and method for connecting the heatspreader.
  8. Schulman Joseph H. ; Canfield Lyle Dean, Hermetically sealed electrical feedthrough for use with implantable electronic devices.
  9. Kong Alvin M. (Los Angeles CA) Lau James C. (Torrance CA) Chan Steven S. (Alhambra CA), Mass simultaneous sealing and electrical connection of electronic devices.
  10. Brand J. Michael, Method and apparatus for filling a gap between spaced layers of a semiconductor.
  11. Beck Walter,DEX ; Roethlingshoefer Walter,DEX ; Nitsche Detlef,DEX, Method for manufacturing ceramic multilayer circuit.
  12. Nelson Bradley H. (Austin TX), Method of assembling stacks of integrated circuit dies.
  13. Wei Chengping ; Shi Song Q. ; Lee Hsing-Chung, Method of manufacturing an integrated electro-optical package.
  14. Ruby Richard C. ; Bell Tracy E. ; Geefay Frank S. ; Desai Yogesh M., Microcap wafer-level package with vias.
  15. Lebaschi Ali, Multi-layer PCB blockade-via pad-connection.
  16. Hall Douglas W. ; Jakobson Paul A. ; Sharps Julia Alyson ; Bartholomew Roger F., Packaging of high power semiconductor lasers.
  17. Higashida Takaaki,JPX ; Kumagai Koichi,JPX ; Matsuo Takahiro,JPX, Semiconductor element-mounting board and semiconductor device.
  18. Arima Hideo (Yokohama JPX) Matsui Kiyoshi (Yokohama JPX) Takeda Kenji (Kamakura JPX), Semiconductor package employing substrate assembly having a pair of thin film circuits disposed one on each of oppositel.
  19. Soga Tasao (Hitachi JPX) Goda Marahiro (Hitachi JPX) Nakano Fumio (Hitachi JPX) Kushima Tadao (Ibaraki JPX) Ushifusa Nobuyuki (Hitachi JPX) Kobayashi Fumiyuki (Sagamihara JPX) Sawahata Mamoru (Hitach, Semiconductor resin package structure.
  20. Brady Michael F. (Morrisville PA) Deshmukh Rajan D. (Yardley PA), Solder self-alignment methods.
  21. Hirose Shinichi,JPX ; Mizuno Naohito,JPX, Structure for mounting electronic components and method for mounting the same.
  22. Beilin Solomon I. (San Carlos CA) Peters Michael G. (Santa Clara CA) Lee Michael G. (San Jose CA) Wang Wen-chou V. (Cupertino CA), Through hole interconnect substrate fabrication process.
  23. Mitchell Craig S. ; Distefano Thomas H., Vacuum dispense apparatus for dispensing an encapsulant.
  24. Ohmuro Kazuhiko,JPX, Wiring structure for semiconductor element and method for forming the same.

이 특허를 인용한 특허 (5) 인용/피인용 타임라인 분석

  1. Fjelstad, Joseph C, Flexible circuit assembly without solder.
  2. Carlson, Gregory A.; Summers, Jeffery F., Hermetic interconnect structure and method of manufacture.
  3. Tomoda, Katsuhiro; Hirao, Naoki; Biwa, Goshi, Light emitting unit and display device.
  4. Whitney, Peter S.; Flanders, Dale C., Method and system for avoiding package induced failure in swept semiconductor source.
  5. Whitney, Peter S.; Flanders, Dale C., Method and system for avoiding package induced failure in swept semiconductor source.

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