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Bumping process 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/44
출원번호 US-0886834 (2001-06-21)
발명자 / 주소
  • Kuo, Wen-Chang
  • Wang, Szu-Yao
출원인 / 주소
  • Taiwan Semiconductor Manufacturing Co., Ltd
대리인 / 주소
    Tung & Associates
인용정보 피인용 횟수 : 19  인용 특허 : 4

초록

A process of forming a solder bump on a semiconductor device including vibrating a solder reservoir carrier in a vertical direction while pressure and heat are applied to the solder reservoir. An engagement surface of the solder reservoir is contacted with an engagement surface of the semiconductor

대표청구항

A process of forming a solder bump on a semiconductor device including vibrating a solder reservoir carrier in a vertical direction while pressure and heat are applied to the solder reservoir. An engagement surface of the solder reservoir is contacted with an engagement surface of the semiconductor

이 특허에 인용된 특허 (4)

  1. Smith Ted M. (Austin TX) Winstead Russell E. (Raleigh NC), Electrodynamic pump for dispensing molten solder.
  2. Bobbio Stephen M. ; Rinne Glenn A., Fluorinated fluxless soldering.
  3. Ulmer Kenneth R., Method for coupling a circuit component to a substrate.
  4. Warren M. Farnworth, Method for generating continuous stream of liquid metal droplets.

이 특허를 인용한 특허 (19)

  1. Lee, Chunghsin; Zhang, Jian, Arrangement for solder bump formation on wafers.
  2. Lee,David, Die holding apparatus for bonding systems.
  3. Jan, Jong Rong; Lu, Tsai Hua; Chiu, Sao Ling; Kung, Ling Chen, Electronic devices including offset conductive bumps.
  4. Nair, Krishna K.; Rinne, Glenn A.; Batchelor, William E., Electronic structures including conductive layers comprising copper and having a thickness of at least 0.5 micrometers.
  5. Nair, Krishna K.; Rinne, Glenn A.; Batchelor, William E., Electronic structures including conductive shunt layers.
  6. Islam, Shafidul; San Antonio, Romarico Santos; Subagio, Anang, Lead frame routed chip pads for semiconductor packages.
  7. Islam, Shafidul; San Antonio, Romarico Santos; Subagio, Anang, Lead frame routed chip pads for semiconductor packages.
  8. Rinne,Glenn A.; Nair,Krishna K., Low temperature methods of bonding components and related structures.
  9. Criel, Bjorn; Van Schaftingen, Jules-Joseph; De Henau, Pascal, Method for fastening an accesory in a plastic fuel tank.
  10. Criel, Bjorn; Van Schaftingen, Jules-Joseph; De Henau, Pascal, Method for fastening an accessory in a plastic fuel tank.
  11. Criel, Bjorn; Van Schaftingen, Jules-Joseph; De Henau, Pascal, Method for fastening an accessory in a plastic fuel tank.
  12. Nair, Krishna K.; Rinne, Glenn A.; Batchelor, William E., Methods of forming electronic structures including conductive shunt layers and related structures.
  13. Nair,Krishna K.; Rinne,Glenn A.; Batchelor,William E., Methods of forming electronic structures including conductive shunt layers and related structures.
  14. Mis, J. Daniel; Adema, Gretchen; Bumgarner, Susan; Chilukuri, Pooja; Rinne, Christine; Rinne, Glenn, Methods of forming lead free solder bumps.
  15. Rinne, Glenn A., Methods of forming metal layers using multi-layer lift-off patterns.
  16. Jan,Jong Rong; Lu,Tsai Hua; Chiu,Sao Ling; Kung,Ling Chen, Methods of selectively bumping integrated circuit substrates and related structures.
  17. Batchelor, William E.; Rinne, Glenn A., Non-Circular via holes for bumping pads and related structures.
  18. Rinne,Glenn A., Optical structures including liquid bumps and related methods.
  19. Mis, J. Daniel; Adema, Gretchen; Bumgarner, Susan; Chilukuri, Pooja; Rinne, Christine; Rinne, Glenn, Solder structures including barrier layers with nickel and/or copper.
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