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[미국특허] Apparatus and method for interleaved packet storage 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H04L-012/28
출원번호 US-0434159 (1999-11-04)
발명자 / 주소
  • Melaragni, William
  • Ladwig, Geoffrey B.
  • Angle, Richard L.
대리인 / 주소
    Fish & Richardson P.C.
인용정보 피인용 횟수 : 23  인용 특허 : 7

초록

An apparatus and method for storage of memory packets with a high aggregate bandwidth is disclosed. An odd-even memory bank structure effectively doubles the memory available for packet storage. A packet memory arbitration scheme aligns access of devices reading and writing into packet memory allowi

대표청구항

An apparatus and method for storage of memory packets with a high aggregate bandwidth is disclosed. An odd-even memory bank structure effectively doubles the memory available for packet storage. A packet memory arbitration scheme aligns access of devices reading and writing into packet memory allowi

이 특허에 인용된 특허 (7) 인용/피인용 타임라인 분석

  1. Rod G. Fleck ; Klaus Oberlaender ; Gigy Baror IL; Alfred Eder DE; Le Trong Nguyen, Data processing device with memory coupling unit.
  2. Holt Craig Sheppard ; Kline Richard ; Ramakrishnan Krishnan, Efficient output-request packet switch and method.
  3. Bertin Claude L. ; Hedberg Erik L., High performance, high bandwidth memory bus architecture utilizing SDRAMs.
  4. Holland Stephen ; Tucker Gregory L., Memory control architecture for high-speed transfer operations.
  5. Harness Jeffrey F., Memory controller with burst addressing circuit.
  6. Scaringella Stephen Lawrence ; Sne Gal ; Tung Victor Wai Ner, Redundant writing of data to cached storage system.
  7. Matthew J. Adiletta ; William Wheeler ; James Redfield ; Daniel Cutter ; Gilbert Wolrich, SRAM controller for parallel processor architecture including address and command queue and arbiter.

이 특허를 인용한 특허 (23) 인용/피인용 타임라인 분석

  1. Larson, Douglas A.; Cronin, Jeffrey J, Apparatus and method for data bypass for a bi-directional data bus in a hub-based memory sub-system.
  2. Larson, Douglas A.; Cronin, Jeffrey J., Apparatus and method for data bypass for a bi-directional data bus in a hub-based memory sub-system.
  3. Larson, Douglas A.; Cronin, Jeffrey J., Apparatus and method for data bypass for a bi-directional data bus in a hub-based memory sub-system.
  4. Kalapathy, Paul; Jorda, Michael A., Apparatus and method for sorted table binary search acceleration.
  5. Meyer, James W.; Kanski, Cory, Arbitration system and method for memory responses in a hub-based memory system.
  6. Zhang,Junchao; Ju,Dz ching (Roy); Lian,Ruiqi; Lueh,Guei Yuan; Zhang,Zhaoqing, Bank assignment for partitioned register banks.
  7. Barrack, Craig; Wang, Yeong; Chang, Rong-Feng, Compact packet switching node storage architecture employing double data rate synchronous dynamic RAM.
  8. Bishara, Nafea, Dynamic random access memory controller.
  9. Mann, Eric K.; Connor, Patrick L.; Diamant, Nimrod, Ingress processing optimization via traffic classification and grouping.
  10. Mann,Erik K.; Connor,Patrick L.; Nimrod,Diamant, Ingress processing optimization via traffic classification and grouping.
  11. Jeddeloh, Joseph M.; James, Ralph, Memory arbitration system and method having an arbitration packet protocol.
  12. Jeddeloh, Joseph M.; James, Ralph, Memory arbitration system and method having an arbitration packet protocol.
  13. Yang,Feng Jong Edward; Erimli,Bahadir, Method and apparatus for accessing external memories.
  14. Jeanne, Ludovic; Fontaine, Patrick; Guguen, Charline, Method of transmitting data packets.
  15. Conner, Patrick; Pavlas, Chris; Kappler, Elizabeth M.; Jared, Matthew A.; Hong, Duke C.; Dubal, Scott P., NUMA aware network interface.
  16. Mann, Erik K.; Connor, Patrick L.; Nimrod, Diamant, Packet aggregation.
  17. Makikeni, Srihari; Iyer, Ravi; Minturn, Dave; Sen, Sujoy; Newell, Donald; Zhao, Li, Packet coalescing.
  18. Makineni, Srihari; Iyer, Ravi; Minturn, Dave; Sen, Sujoy; Newell, Donald; Zhao, Li, Packet coalescing.
  19. Makineni, Srihari; Iyer, Ravishankar; Minturn, David; Sen, Sujoy; Newell, Donald; Zhao, Li, Packet coalescing.
  20. Musoll, Enrique; Nemirovsky, Mario; Huynh, Jeffrey, Packet processor that generates packet-start offsets to immediately store incoming streamed packets using parallel, staggered round-robin arbitration to interleaved banks of memory.
  21. Usui, Daisuke; Yoshimura, Hideyoshi, Pixel input-output method, image compressing method, pixel input-output apparatus, image compressing apparatus, image processing apparatus, image forming apparatus, computer program and recording medium.
  22. Mann, Erik K.; Connor, Patrick L.; Nimrod, Diamant, Queuing based on packet classification.
  23. Jiao,Yang (Jeff); Chen,Yiping; Chen,Wen Chung, Selecting multiple threads for substantially concurrent processing.

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