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[미국특허] Aluminum/copper clad interconnect layer for VLSI applications 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/44
출원번호 US-0222361 (2002-08-16)
발명자 / 주소
  • Jeng, Shin-Puu
  • Hou, Shang-Yun
출원인 / 주소
  • Taiwan Semiconductor Manufacturing Company
대리인 / 주소
    Saile George O.
인용정보 피인용 횟수 : 9  인용 특허 : 11

초록

A method of forming at least one aluminum/copper clad interconnect comprising the following steps. A substrate is provided having an overlying patterned dielectric layer. The patterned dielectric layer having at least one lower opening. The at least one lower opening is lined with a first barrier la

대표청구항

1. A method of forming at least one aluminum/copper clad routing layer, comprising the steps of:providing a substrate having an overlying patterned dielectric layer; the patterned dielectric layer having at least one lower opening;lining the at least one lower opening with a first barrier layer;form

이 특허에 인용된 특허 (11) 인용/피인용 타임라인 분석

  1. Butt Sheldon H. (Godfrey IL), Chip carrier.
  2. Sammy K. Brown ; George E. Avery ; Andrew K. Wiggin ; Samuel W. Beal, Integrated circuits packaging system and method.
  3. Fulford ; Jr. H. Jim ; Bandyopadhyay Basab ; Dawson Robert ; Hause Fred N. ; Michael Mark W. ; Brennan William S., Method of forming a recessed interconnect structure.
  4. Lake Harold (Sharon MA) Grandmont Paul E. (Franklin MA), Multilayer circuit board fabrication process.
  5. Mennucci Joseph P. (Manville RI), Multilayer metal leadframe.
  6. Sudhindranath Sira G. ; Sethuraman Anand, Off-grid metal layer utilization.
  7. Dalal Hormazdyar M. ; Nguyen Du Binh ; Rathore Hazara S., Self-aligned composite insulator with sub-half-micron multilevel high density electrical interconnections and process thereof.
  8. Gary K. Giust ; Ruggero Castagnetti ; Yauh-Ching Liu ; Subramanian Ramesh, Self-aligned fuse structure and method with dual-thickness dielectric.
  9. Downey, Susan H.; Miller, James W.; Hall, Geoffrey B., Semiconductor device having a wire bond pad and method therefor.
  10. Dalal Hormazdyar M. ; Nguyen Du Binh ; Rathore Hazara S., Sub-half-micron multi-level interconnection structure and process thereof.
  11. Brown Sammy K. ; Avery George E. ; Wiggin Andrew K., System and method for routing connections of integrated circuits.

이 특허를 인용한 특허 (9) 인용/피인용 타임라인 분석

  1. Tseng, Horng-Huei; Hu, Chenming, Aluminum-based interconnection in bond pad layer.
  2. Cooney, III, Edward C.; Dang, Dinh; DeMuynck, David A.; McTaggart, Sarah A.; Milo, Gary L.; Roma, Melissa J.; Thompson, Jeffrey L.; Weeks, Thomas W., Metal wires of a stacked inductor.
  3. Lee, Byung Zu; Kim, Hyun Yong, Method of forming copper wire on semiconductor device.
  4. Chen, Chun-Liang, Semiconductor device allowing metal layer routing formed directly under metal pad.
  5. Chen, Chun-Liang, Semiconductor device allowing metal layer routing formed directly under metal pad.
  6. Chen, Chun-Liang; Chang, Tien-Chang; Lin, Chien-Chih, Semiconductor device allowing metal layer routing formed directly under metal pad.
  7. Chen, Chun-Liang; Chang, Tien-Chang; Lin, Chien-Chih, Semiconductor device allowing metal layer routing formed directly under metal pad.
  8. Chen, Chun-Liang; Chang, Tien-Chang; Lin, Chien-Chih, Semiconductor device allowing metal layer routing formed directly under metal pad.
  9. Okada, Norio, Semiconductor device having a fuse.

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