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Package for integrated circuit with thermal vias and method thereof 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/44
  • H01L-021/48
  • H01L-021/50
출원번호 US-0703343 (2003-11-06)
발명자 / 주소
  • Sharma, Nirmal K.
출원인 / 주소
  • Intersil Corporation
대리인 / 주소
    MacPherson Kwok Chen &
인용정보 피인용 횟수 : 16  인용 특허 : 8

초록

A method for enhancing thermal performance of an integrated circuit package attaches a dummy die to the semiconductor die of the integrated circuit. The dummy die is then thermally coupled through external terminals to the conductive layers of a printed circuit board. In one embodiment, the integrat

대표청구항

1. A method for enhancing heat dissipation in a packaged integrated circuit comprising:attaching a semiconductor die with an electronic circuit to a heat spreader to create a thermal contact between the semiconductor die and the heat spreader; providing conductive terminals on a first surface and a

이 특허에 인용된 특허 (8)

  1. Ference Thomas G. ; Howell Wayne J. ; Sprogis Edmund J., Dual chip with heat sink.
  2. Hashemi Hassan S., Leadless chip carrier design and structure.
  3. Katchmar, Roman, Mechanically-stabilized area-array device package.
  4. Wang Hsueh-Te,TWX ; Tao Su,TWX, Method of making stacked chip package.
  5. Michii, Kazunari; Akiyama, Tatsuhiko, Multiple chip package semiconductor device.
  6. Gallas William N., Packaging multiple dies on a ball grid array substrate.
  7. Yasuki Fukui JP; Yoshiki Sota JP; Yuji Matsune JP; Atsuya Narai JP, Semiconductor device and method of manufacturing the same.
  8. Kikuma, Katsuhito; Ikeda, Mitsutaka; Tsukidate, Yoshihiro; Akashi, Yuji; Ozawa, Kaname; Takashima, Akira; Uno, Tadashi; Nishimura, Takao; Ando, Fumihiko; Onodera, Hiroshi; Okuda, Hayato, Stacked semiconductor device and method of producing the same.

이 특허를 인용한 특허 (16)

  1. David, Paul; Taylor, William P.; Scheller, P. Karl; Vig, Ravi; Friedrich, Andreas P., Integrated circuit package having a split lead frame.
  2. Taylor, William P.; David, Paul; Vig, Ravi, Integrated circuit package having a split lead frame.
  3. David, Paul; Vig, Ravi; Taylor, William P.; Friedrich, Andreas P., Integrated circuit package having a split lead frame and a magnet.
  4. Vig, Ravi; Taylor, William P.; David, Paul A.; Scheller, P. Karl; Friedrich, Andreas P., Magnetic field sensor integrated circuit with an electromagnetic suppressor.
  5. Vig, Ravi; Taylor, William P.; David, Paul; Scheller, P. Karl; Friedrich, Andreas P., Magnetic field sensor integrated circuit with integral ferromagnetic material.
  6. Vig, Ravi; Taylor, William P.; Friedrich, Andreas P.; David, Paul; Lo, Marie-Adelaide; Burdette, Eric; Shoemaker, Eric; Doogue, Michael C., Magnetic field sensor integrated circuit with integral ferromagnetic material.
  7. Taylor, William P.; Vig, Ravi, Methods and apparatus for integrated circuit having multiple dies with at least one on chip capacitor.
  8. Taylor, William P., Methods and apparatus for integrated circuit having on chip capacitor with eddy current reductions.
  9. Milano, Shaun D.; Doogue, Michael C.; Taylor, William P., Methods and apparatus for magnetic sensor having non-conductive die paddle.
  10. Milano, Shaun D.; Doogue, Michael C.; Taylor, William P., Methods and apparatus for magnetic sensor having non-conductive die paddle.
  11. Milano, Shaun D.; Doogue, Michael C.; Taylor, William P., Methods and apparatus for magnetic sensor having non-conductive die paddle.
  12. Taylor, William P., Methods for sensor having capacitor on chip.
  13. Mertol, Atila, Preferentially cooled electronic device.
  14. Sharma, Nirmal; Ararao, Virgil; Magpantay, Leonardo T.; Engle, Raymond W.; Taylor, William P.; Doogue, Kirsten; Gagnon, Jay, Sensor and method of providing a sensor.
  15. Lee, Seok-Chan, Stacked semiconductor package.
  16. Lee, Seok-Chan, Stacked semiconductor package.
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