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Remote translation mechanism for a multi-node system 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-012/10
출원번호 US-0235898 (2002-09-04)
발명자 / 주소
  • Scott, Steven L.
출원인 / 주소
  • Cray Inc.
대리인 / 주소
    Schwegman, Lundberg, Woessner &
인용정보 피인용 횟수 : 26  인용 특허 : 7

초록

A remote translation mechanism for a multi-node system. One embodiment of the invention provides a method for remotely translating a virtual memory address into a physical memory address in a multi-node system. The method includes providing the virtual memory address at a source node, determining th

대표청구항

1. A method for remotely translating a virtual memory address into a physical memory address in a multi-node system, the method comprising:providing the virtual memory address at a source node; determining that the virtual memory address is to be sent to a remote node; sending the virtual memory add

이 특허에 인용된 특허 (7)

  1. Vishin Sanjay ; Aybay Gunes, Auxiliary translation lookaside buffer for assisting in accessing data in remote address spaces.
  2. Papadopoulos Gregory M. (Acton MA) Nikhil Rishiyur S. (Arlington MA) Greiner Robert J. (Chandler AZ) Arvind (Arlington MA), Data processing system with synchronization coprocessor for multiple threads.
  3. Papadopoulos Gregory M. (Burlington MA) Nikhil Rishiyur S. (Arlington MA) Greiner Robert J. (Chandler AZ) Arvind (Arlington MA), Data processing system with synchronization coprocessor for multiple threads.
  4. Carter Nicholas P. ; Keckler Stephen W. ; Dally William J., Memory system with global address translation.
  5. Yamazaki Takeshi (Tokyo JPX), Multiprocessor system for locally managing address translation table.
  6. Nesheim William A. ; Guzovskiy Aleksandr, Multiprocessor system having mapping table in each node to map global physical addresses to local physical addresses of.
  7. Pierce Paul R. (Portland OR), Parallel processing system virtual connection method and apparatus with protection and flow control.

이 특허를 인용한 특허 (26)

  1. Faanes,Gregory J.; Scott,Steven L.; Lundberg,Eric P.; Moore, Jr.,William T.; Johnson,Timothy J., Decoupled scalar/vector computer architecture system and method.
  2. Scott, Steven L.; Faanes, Gregory J., Decoupling of write address from its associated write data in a store to a shared memory in a multiprocessor system.
  3. Carpentier, Paul R. M.; Turpin, Russell, Elimination of duplicate objects in storage clusters.
  4. Baker, Don; Carpentier, Paul R. M.; Klager, Andrew; Pierce, Aaron; Ring, Jonathan; Turpin, Russell; Yoakley, David, Erasure coding and replication in storage clusters.
  5. Baker, Don; Carpentier, Paul R. M.; Klager, Andrew; Pierce, Aaron; Ring, Jonathan; Turpin, Russell; Yoakley, David, Erasure coding and replication in storage clusters.
  6. Gordon, Mark R., I/O mapping-path tracking in a storage configuration.
  7. Kohn,James R., Indirectly addressed vector load-operate-store method and apparatus.
  8. Scott, Steven L., Latency tolerant distributed shared memory multiprocessor computer.
  9. Pautsch, Gregory W.; Pautsch, Adam, Method and apparatus for cooling electronic components.
  10. Kohn, James R., Method and apparatus for indirectly addressed vector load-add-store across multi-processors.
  11. Kohn,James R., Method and apparatus for indirectly addressed vector load-add-store across multi-processors.
  12. Savagaonkar, Uday; Sahita, Ravi; Durham, David, Monitoring a target agent execution pattern on a VT-enabled system.
  13. Scott,Steven L.; Faanes,Gregory J.; Stephenson,Brick; Moore, Jr.,William T.; Kohn,James R., Multistream processing memory-and barrier-synchronization method and apparatus.
  14. Krakirian, Shahe Hagop; Akkawi, Isam, Node identification for distributed shared memory system.
  15. Scott, Steven L.; Faanes, Gregory J.; Stephenson, Brick; Moore, Jr., William T.; Kohn, James R., Relaxed memory consistency model.
  16. Sheets, Kitrick; Hastings, Andrew B., Remote translation mechanism for a multinode system.
  17. Klausler, Peter M., Scheduling synchronization of programs running as streams on multiple processors.
  18. Sheets,Kitrick; Williams,Josh; Gettler,Jonathan; Piatz,Steve; Hastings,Andrew B.; Hill,Peter; Bravatto,James G.; Kohn,James R.; Titus,Greg, Scheduling synchronization of programs running as streams on multiple processors.
  19. Sheets, Kitrick, Sharing memory within an application using scalable hardware resources.
  20. Leinberger, William J.; Kowalski, Bobby Jim; Denny, Ronald R., System and method for managing addresses in a computing system.
  21. Faanes, Gregory J.; Lundberg, Eric P.; Scott, Steven L.; Baird, Robert J., System and method for processing memory instructions using a forced order queue.
  22. Savagaonkar, Uday; Sahita, Ravi; Durham, David; Khosravi, Hormuzd, Tamper protection of software agents operating in a vitual technology environment methods and apparatuses.
  23. Carpentier, Paul R. M.; Turpin, Russell, Two level addressing in storage clusters.
  24. Carpentier, Paul R. M.; Turpin, Russell, Two level addressing in storage clusters.
  25. Carpentier, Paul R. M.; Turpin, Russell, Two level addressing in storage clusters.
  26. Carpentier, Paul R.M.; Turpin, Russell, Two level addressing in storage clusters.
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