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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0737315 (2003-12-15) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 9 인용 특허 : 40 |
Method and structures are provided for conformal lining of dual damascene structures in integrated circuits. Trenches and contact vias are formed in insulating layers. The trenches and vias are exposed to alternating chemistries to form monolayers of a desired lining material. Exemplary process flow
What is claimed is: 1. A dual damascene structure in an integrated circuit, comprising; a trench formed in an insulating layer; at least one contact via extending from a floor of the trench downwardly to a conductive element below; and a conductive lining layer along surfaces of the trench and the
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