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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0051759 (2013-10-11) |
등록번호 | US-8732225 (2014-05-20) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 0 인용 특허 : 213 |
Digital signal processing (“DSP”) block circuitry on an integrated circuit (“IC”) is adapted for use (e.g., in multiple instances of the DSP block circuitry on the IC) for implementing finite-impulse-response (“FIR”) digital filters in systolic form. Each DSP block may include (1) first and second m
1. Digital signal processing (“DSP”) block circuitry comprising: first multiplier circuitry for producing a first output signal indicative of a first multiplication product of a multiplicand signal and a multiplier signal;first systolic delay circuitry for delaying at least one of (1) the multiplica
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