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Mechanism for increasing parallelization in computer programs with read-after-write dependencies associated with prefix operations 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-009/46
  • G06F-009/45
출원번호 US-0493538 (2009-06-29)
등록번호 US-8949852 (2015-02-03)
발명자 / 주소
  • Cypher, Robert E.
출원인 / 주소
  • Oracle America, Inc.
대리인 / 주소
    Park, Vaughan, Fleming & Dowler LLP
인용정보 피인용 횟수 : 0  인용 특허 : 6

초록

Some embodiments provide a system that increases parallelization in a computer program. During operation, the system obtains a binary associative operator and a ordered set of elements associated with a prefix operation in the computer program. Next, the system divides the elements into multiple set

대표청구항

1. A computer-implemented method for increasing parallelization in a computer program, comprising: obtaining a binary associative operator and an ordered set of elements associated with a prefix operation in the computer program;dividing the elements into multiple sets of contiguous iterations based

이 특허에 인용된 특허 (6)

  1. Hardwick Jonathan C.,GBX, Dynamic load balancing among processors in a parallel computer.
  2. Archambault, Roch G.; Gao, Yaoqing; Ren, Zhixing; Silvera, Raul E., Framework for parallelizing general reduction.
  3. DeHon, Andre M.; Kapre, Nachiket, Method and a circuit using an associative calculator for calculating a sequence of non-associative operations.
  4. Sundaresan Neelakantan, Method of, system for, and article of manufacture for providing a generic reduction object for data parallelism.
  5. Wilkinson Paul Amba ; Dieffenderfer James Warren ; Kogge Peter Michael ; Schoonover Nicholas Jerome, SIMD/MIMD array processor with vector processing.
  6. Le Grand, Scott M., Work-efficient parallel prefix sum algorithm for graphics processing units.
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