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Method of embedding WLCSP components in e-WLB and e-PLB 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-023/34
  • H01L-025/16
  • H01L-021/56
  • H01L-023/00
  • H01L-025/03
  • H01L-025/10
  • H01L-025/00
  • H01L-023/538
출원번호 US-0767902 (2014-09-18)
등록번호 US-9991239 (2018-06-05)
국제출원번호 PCT/US2014/056406 (2014-09-18)
국제공개번호 WO2016/043761 (2016-03-24)
발명자 / 주소
  • Nair, Vijay K.
  • Meyer, Thorsten
출원인 / 주소
  • Intel Corporation
대리인 / 주소
    Schwabe, Williamson & Wyatt, P.C.
인용정보 피인용 횟수 : 0  인용 특허 : 14

초록

Embodiments of the invention include multi-die package and methods of making such multi-die packages. In an embodiment a mold layer has a first surface and a second surface that is opposite from the first surface. One or more first electrical components that each have a solderable terminal that is o

대표청구항

1. A multi-die package comprising: a mold layer having a first surface and a second surface that is opposite from the first surface;one or more first electrical components, wherein each of the first electrical components have a solderable terminal that is oriented to face the first surface of the mo

이 특허에 인용된 특허 (14)

  1. Mess Leonard E., Ball grid array (BGA) encapsulation mold.
  2. Yamashita,Yoshihisa; Hirano,Koichi; Sugaya,Yasuhiro; Asahi,Toshiyuki; Nakatani,Seiichi, Electronic component built-in module and method of manufacturing the same.
  3. Rostoker Michael D. (San Jose CA) Pasch Nicholas F. (Pacifica CA) Schneider Mark (San Jose CA), Fluid-filled and gas-filled semiconductor packages.
  4. Lin, Mou-Shiung; Lee, Jin-Yuan; Huang, Ching-Cheng, Integrated chip package structure using organic substrate and method of manufacturing the same.
  5. Yoo, Do-Jae; Kweon, Young-Do; Choi, Seog-Moon; Jang, Bum-Sik; Jeong, Tae-Sung, Method for manufacturing a semiconductor package.
  6. Yoo, Do-Jae; Kweon, Young-Do; Choi, Seog-Moon; Jang, Bum-Sik; Jeong, Tae-Sung, Method of manufacturing a semiconductor package.
  7. Sun, Haixiao; Lu, Daoqiang; Xu, Aiying, Multi-die molded substrate integrated circuit device.
  8. Jiang, Hunt Hang, Multi-die packages incorporating flip chip dies and associated packaging methods.
  9. Mostafazadeh Shahram (San Jose CA) Chillara Satya (San Jose CA) Belani Jagdish (Cupertino CA), Semiconductor component package assembly including an integral RF/EMI shield.
  10. Marimuthu, Pandi Chelvam; Suthiwongsunthorn, Nathapong; Shim, Il Kwon; Heng, Kock Liang, Semiconductor device and method of forming an interposer package with through silicon vias.
  11. Lin, Yaojian; Chen, Kang, Semiconductor device and method of forming build-up interconnect structures over carrier for testing at interim stages.
  12. Huang, Rui; Kuan, Heap Hoe; Lin, Yaojian; Chow, Seng Guan, Semiconductor device and method of forming three-dimensional vertically oriented integrated capacitors.
  13. Yoo, Do-Jae; Kweon, Young-Do; Choi, Seog-Moon; Jang, Bum-Sik; Jeong, Tae-Sung, Semiconductor package.
  14. Yoo, Do-Jae; Kweon, Young-Do; Choi, Seog-Moon; Jang, Burn-Sik; Jeong, Tae-Sung, Semiconductor package and method for manufacturing thereof.
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