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연합인증

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모바일 연동 RFID 리더 개발 기술 원문보기

보고서 정보
주관연구기관 하이트랙스(주)
연구책임자 박경철
참여연구자 채만희 , 김상욱 , 이대환 , 김준호 , 김성찬
보고서유형최종보고서
발행국가대한민국
언어 한국어
발행년월2006-04
과제시작연도 2005
주관부처 정보통신부
사업 관리 기관 정보통신연구진흥원
Institute for Information Technology Advancement
등록번호 TRKO201000015544
과제고유번호 1440001538
사업명 IT우수신기술지정지원(기금)
DB 구축일자 2013-04-18

초록

가. PDA 등과 같은 모바일 어플리케이션 환경 개발
나. UHF-RFID 모듈(RF, Digital) 및 관련 S/W 일체형
다. 안테나의 최대 1W 출력을 지원하기 위한 밧데리와 충/방전 회로 내장
라. Ethernet 시리얼을 통한 시스템 연동 지원
마. 자국 허용 UHF-RFID 주파수 대역별 제품 생산

목차 Contents

  • 표지 ...1
  • 제출문 ...2
  • 요약문 ...3
  • 목차 ...6
  • 그림목차 ...10
  • 표목차 ...15
  • 제1장 서론 ...18
  • 제1절 RFID 개요 ...18
  • 1. RFID 개요 ...18
  • 2. RFID의 중요성 ...20
  • 3. RFID 특징 및 기술동향 ...20
  • 제2절 RFID 표준화 ...29
  • 제3절 연구의 개요 ...33
  • 제4절 연구배경 ...33
  • 제5절 연구 목표 ...34
  • 1. 시스템의 형태 ...34
  • 2. 긴 인식거리 ...34
  • 3. 저전력 설계 ...34
  • 제2장 리더 시스템 구조 ...35
  • 제1절 시스템 구성 ...35
  • 제2절 전체적 기능 흐름 ...36
  • 제3절 구조 설명 ...36
  • 제3장 H/W 구성 요소 ...37
  • 제1절 RF 부 ...37
  • 1. 기능 ...37
  • 2. 구성 ...37
  • 3. 성능 ...39
  • 4. 상세 설계 개요 ...40
  • 5. 인터페이스 ...43
  • 제2절 블록별 RF부 상세 설계 ...44
  • 1. 송신 블록 ...44
  • 2. Modulation (변조) ...46
  • 3. Power Amp 및 Power Control ...48
  • 4. 수신 블록 ...50
  • 5. Demodulation (복조) ...53
  • 6. 주파수 생성블록(PLL) ...56
  • 7. PLL ...57
  • 제3절 디지털부 ...69
  • 1. 기능 ...70
  • 2. 구조설명 ...70
  • 3. A/D 변환기 ...72
  • 4. D/A 변환기 ...73
  • 5. FPGA ...76
  • 6. CPU ...83
  • 7. DSP ...89
  • 8. 호스트 인터페이스 ...98
  • 9. 상태표시등 ...100
  • 제4절 전원부 ...102
  • 1. 기능 ...102
  • 2. 구성 ...102
  • 3. 성능 ...102
  • 4. 인터페이스 ...103
  • 제4장 FPGA Firmware 구성 ...104
  • 제1절 Firmware 전체 블록 ...105
  • 1. 동작 클럭 분류 및 설명 ...105
  • 2. 전체 시스템 블록 구성도 ...106
  • 제2절 기능별 상세 블록 ...108
  • 1. 블록별 기능 및 인터페이스 ...108
  • 2. Host 인터페이스 블록 ...110
  • 3. DPRAM 인터페이스 ...111
  • 4. Command Analysis & Control Block(CACB) ...115
  • 5. Internal Device Control Block(IDCB) ...118
  • 6. External Device Control Block (EDCB) ...120
  • 제3절 레지스터 구조 및 동작 절차 설명 ...124
  • 1. 명령 레지스터 ...124
  • 2. 상태 레지스터 ...125
  • 3. DAC 컨트롤 ...125
  • 4. ADC 상태 레지스터 ...126
  • 5. chip selection 레지스터 ...127
  • 6. GEN2 Register ...128
  • 제4절 FPGA 통합실험절차 및 결과 ...135
  • 1. 시험 개요 ...135
  • 2. 시험 구성도 ...136
  • 3. PLL 주파수 시험 ...137
  • 4. 리더 Command 시험 ...145
  • 5. 태그 응답 시험 ...150
  • 6. 태그 Reading 시험 ...156
  • 제5장 CPU S/W 구성 및 기능 ...160
  • 제1절 CPU S/W ...160
  • 1. CPU S/W의 구성 ...160
  • 2. CPU S/W 시스템 동작설명 ...160
  • 3. CPU S/W 전체 모듈간의 세부 모듈 구성 ...162
  • 제2절 Reader Main ...164
  • 1. 기능 및 구성 ...164
  • 2. 동작 설명 ...164
  • 3. 세부 모듈 ...165
  • 4. 모듈 설계 ...167
  • 제3절 Command Response Unit ...171
  • 1. 기능 및 구성 ...171
  • 2. 동작 설명 ...172
  • 3. 세부 모듈 ...172
  • 4. 모듈 설계 ...174
  • 제4절 Reader Connection Manager ...178
  • 1. 기능 및 구성 ...178
  • 2. 동작 설명 ...178
  • 3. 세부 모듈 ...179
  • 4. 모듈 설계 ...180
  • 제5절 Reader API Unit ...188
  • 1. 기능 및 구성 ...188
  • 2. 동작 설명 ...188
  • 3. 세부 모듈 ...189
  • 4. 모듈 설계 ...191
  • 제6절 Data Handling Unit ...206
  • 1. 기능 및 구성 ...206
  • 2. 동작 설명 ...207
  • 3. 세부 모듈 ...207
  • 4. 모듈 설계 ...210
  • 제7절 Protocol Control Unit ...221
  • 1. 기능 및 구성 ...221
  • 2. 동작 설명 ...222
  • 3. 세부 모듈 ...244
  • 4. 모듈 설계 ...248
  • 제6장 안테나 구성 ...269
  • 제1절 선형 안테나 ...269
  • 1. 미소다이폴 ...269
  • 2. 유한다이폴 ...271
  • 3. 반파장 다이폴 안테나 ...276
  • 제2절 RFID 리더기용 안테나 설계 ...278
  • 1. 마이크로스트립 패치 안테나 ...278
  • 2. 원편파 패치 안테나 ...279
  • 3. 안테나 설계 및 제작 ...284
  • 제7장 결론 ...304

참고문헌 (25)

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