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나노급 저전압 및 고전압 집적회로용 새로운 구조의 ESD 보호소자 개발
Development of novel ESD protection device for nanoscale low voltage and high voltage integrated circuit 원문보기

보고서 정보
주관연구기관 단국대학교 산학협력단
연구책임자 구용서
보고서유형최종보고서
발행국가대한민국
언어 한국어
발행년월2011-06
과제시작연도 2010
주관부처 교육과학기술부
사업 관리 기관 한국연구재단
등록번호 TRKO201200002702
과제고유번호 1345119940
사업명 일반연구자지원
DB 구축일자 2013-05-20
키워드 정전기.보호소자.사이리스터.반도체 소자.집적회로.신뢰성.래치업.Electrostatic Discharge(ESD).ESD Protection Device.Thyristor.Semiconductor.Integrated Circuit(IC).Reliability.Latch-up.Human Body Model(HBM).TLP.

초록

최근 나노급 이하의 공정기술의 진보와 고전압 시스템의 집적화로 기존 정전기 보호소자의 문제가 개선된 새로운 방식의 ESD 보호소자의 구현 기술이 요구되고 있음. 본 연구는 나노 공정에 기반한 반도체 집적회로와 고전압 공정에 기반한 집적회로를 위한 ESD 보호소자의 개발을 주요 목표로 하며 세부적으로 다음과 같은 특성을 갖는 소자 구현 기술개발을 목적으로 함.
▸ 나노 공정 기반 저전압 집적회로용 ESD 보호소자 개발
· CDM에 적합한 빠른 턴온 속도와 낮은 트리거 전압을 갖는 ESD 보호소자 구현 기술
· 낮은 누

Abstract

Recently, as devices are scaled down to nano-scale regime and high voltage systems are integrated to system-on chip(SoC), novel ESD portection devices are required. The main purpose of the research is to develop the novel ESD protection devices for nanoscale low voltage IC and high voltage IC. The s

목차 Contents

  • 일반연구자지원사업 최종보고서 ... 1
  • 목차 ... 3
  • I. 연구 계획 요약문 ... 4
  • 1. 국문 요약문 ... 4
  • II. 연구 결과 요약문 ... 5
  • 1. 한글요약문 ... 5
  • 2. SUMMARY ... 6
  • III. 연구내용 및 결과 ... 7
  • 1. 연구 개발 과제의 개요 ... 7
  • 2. 국내외 기술 개발 현황 ... 10
  • 3. 연구 수행 내용 및 결과 ... 11
  • 4. 목표 달성도 및 관련 분야에의 기여도 ... 22
  • 5. 연구 결과의 활용 계획 ... 22
  • 6. 연구 과정에서 수집한 해외 과학기술 정보 ... 23
  • 7. 주관연구책임자(공동연구원) 대표적 연구 실적 ... 24
  • 8. 참고 문헌 ... 24
  • 9. 연구 성과 ... 24
  • 10. 기타 성과 ... 25
  • [별첨1] 대표연구성과 ... 26
  • 자체평가 의견서 ... 28

참고문헌 (25)

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