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NTIS 바로가기주관연구기관 | 연세대학교 Yonsei University |
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연구책임자 | 정의영 |
보고서유형 | 최종보고서 |
발행국가 | 대한민국 |
언어 | 한국어 |
발행년월 | 2013-11 |
과제시작연도 | 2012 |
주관부처 | 교육과학기술부 |
사업 관리 기관 | 한국연구재단 |
등록번호 | TRKO201400008719 |
과제고유번호 | 1345172311 |
사업명 | 기본연구지원사업(유형I) |
DB 구축일자 | 2014-06-07 |
본 연구에서는 프로세서와 DRAM의 3차원 적층 환경에서 메모리 성능을 극대화하여 Memory-wall로 인한 성능 저하를 극복하는 기술들을 연구한다. 기존에 많은 연구자들이 DRAM 적층 프로세서 환경에서 메모리 성능 향상에 대해 연구하였으나, 대다수의 연구들은 프로세서와 DRAM의 구조를 변경하지 않은 채 3차원 반도체 적층 기술로 이용해 증가된 와이어(wire) 자원의 활용을 극대화하는데 치중하고 있다. 본 연구에서는 한걸음 더 나아가 TSV(Through Silicon-Via)의 짧은 지연 시간을 보다 적극적으로 활용하고,
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