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연합인증

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CMOS 메모리와 차세대 메모리를 이용한 저전력 저면적 PIM (Processing In Memory) 설계
Area-Optimized Low Power PIM (Processing In Memory) Design using CMOS and post-CMOS Memories 원문보기

보고서 정보
주관연구기관 인하대학교
InHa University
연구책임자 서영교
보고서유형최종보고서
발행국가대한민국
언어 한국어
발행년월2023-03
과제시작연도 2022
주관부처 과학기술정보통신부
Ministry of Science and ICT
등록번호 TRKO202300010141
과제고유번호 1711169337
사업명 개인기초연구(과기정통부)
DB 구축일자 2023-10-11
키워드 인공지능 하드웨어.프로세싱 인 메모리.메모리 회로 설계.스핀트로닉스.신경망 회로 설계.Transposal SRAM Cell.Processing In Memory.Transposal MRAM Cell.Memory Circuit Design.Neural Processing Unit.

초록

□ 연구개요
· CAM 기반 BNN 가속기는 CAM의 검색 작업을 사용하여 BNN에 대한 XNOR 연산은 구현 가능하고 빠른 속도를 제공하지만 XNOR 비트 카운트 연산의 결과값이 process variation에 의해 상당한 오류를 야기시킬 수 있는 문제가 있음. 이를 보완하기 위해 분류 정확도를 높이기 위해 XNOR 비트 카운트 연산의 오류를 줄이기 위한 reference line의 이중화 구조를 설계하고 검증함
· 생물학적 뉴런과 시냅스를 모방한 SNN을 위한 하드웨어를 설계할 때 메모리와 컴퓨팅 블록 간의 데이터

목차 Contents

  • 표지 ... 1
  • 연구결과 요약문 ... 2
  • 목차 ... 3
  • 1. 연구개발과제의 개요 ... 4
  • 2. 연구개발과제의 수행 과정 및 수행 내용 ... 5
  • 1) 1차년도 ... 5
  • 2) 2차년도 ... 6
  • 3) 3차년도 ... 7
  • 3. 연구개발과제의 수행 결과 및 목표 달성 수준 ... 10
  • 1) 정성적 연구개발성과 (연구개발결과) ... 10
  • 2) 세부 정량적 연구개발성과 ... 12
  • 3) 목표 달성 수준 ... 12
  • 4. 연구개발성과의 관련 분야에 대한 기여 정도(연구개발결과의 중요성) ... 12
  • 5. 연구개발성과의 관리 및 활용 계획 ... 13
  • 6. 자체점검표 ... 13
  • 7. 참고문헌 ... 14
  • 붙임1. 세부 정량적 연구개발성과 ... 15
  • 붙임2 연구책임자 대표적 연구실적 및 증빙(요약문 및 사본) ... 18
  • 끝페이지 ... 32

표/그림 (11)

참고문헌 (25)

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