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학위논문 상세정보

8 비트 125 MS/s ADC용 저전력 완전 차동 SHA 회로의 설계

Design of Low Power Fully Differential SHA Circuit for an 8-Bit 125-MS/s


이해원 (경북대학교 대학원 전자전기컴퓨터학부 회로 및 임베디드 시스템 공학전공 국내석사)
Abstract

This thesis describes design techniques for a CMOS sample-and-hold amplifier which achieves a high accuracy of 8 b-level at 125 MHz sampling rate with 1.8-V supply voltage. This thesis proposed an extended transfer function of a fully differential folded-cascode CMOS operational amplifier to apply a...

주제어

#SHA;

저자 이해원
학위수여기관 경북대학교 대학원
학위구분 국내석사
학과 전자전기컴퓨터학부 회로 및 임베디드 시스템 공학전공
발행년도 2010
총페이지 iv, 49 p.
키워드 SHA
언어 kor
원문 URL http://www.riss.kr/link?id=T11971517&outLink=K
정보원 한국교육학술정보원

DOI 인용 스타일

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