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NTIS 바로가기한국전자통신학회 논문지 = The Journal of the Korea Institute of Electronic Communication Sciences, v.7 no.2, 2012년, pp.295 - 301
In this article, we have designed SHA, which has 12 Bit resolution at an input signal range of 1
* AI 자동 식별 결과로 적합하지 않은 문장이 있을 수 있으니, 이용에 유의하시기 바랍니다.
핵심어 | 질문 | 논문에서 추출한 답변 |
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SHA는 무엇인가? | SHA(Sample and Hold Amplifier)는 고해상도 ADC(Analog Digital Converter)[1∼4]시스템 설계 시 매우 민감하고 중요한 부분으로서 전체 해상도의 정밀도와 성능을 크게 좌우하게 된다. SHA는 아날로그 신호를 받아 입력 신호를 표본화하고 일정시간 유지 (Hold)하게 하여 안정전압에서 ADC가 수행되도록 하는 회로이다. | |
폐루프 구조의 단점은 무엇인가? | 폐루프 구조는 개루프 구조에 비해 비교적 정확한 출력을 얻기에 적합한 구조이다. 그러나 궤환 (feedback)을 갖기 때문에 속도가 느리고, 회로가 불안정하다는 단점이 있다. 반면에 개루프 구조의 SHA 는 궤환을 갖지 않으므로 빠른 속도로 동작을 하고, 폐루프 구조의 SHA에 비해 회로가 안정되지만, 샘플링 스위치가 오프 될 때(hold-mode) 발생하는 feedthrough에 의해 제한되는 정밀도 때문에 고해상도를 요구하는 시스템에는 적합하지 않다. | |
고속 ADC용 SHA는 어떤 구조를 사용하는가? | 고속 ADC용 SHA는 속도 조건을 만족하기 위해 폐루프 구조 대신 개루프 구조를 사용한다. 한편, 고속 SHA 회로는 샘플링 된 신호의 감소로 인해 발생 하는 잡음을 최소화하고 ADC가 받아들이는 입력 범위와 매칭 시키는 문제를 고려해야 한다[5]. |
J. Bayard, M. Ayachi, "A proposal to improve the quality of a sample and hold output voltage," Internaltional Journal of Electronics, Vol. 92, No. 4, pp. 243-249, 2005.
C. Paulus et al., "A 4GS/s 6b flash ADC in 0.13um CMOS," in Symposium on VLSI Circuits Digest of Technical Papers, pp. 420-423, Jun. 2004.
배성환, 이창기, 김대익, "Multi-channel Incremental Data Converters", 한국전자통신학회논문지, 4권, 1호, pp. 31-34, 2009.
Behzad Razavi. Principles of Data Conversion System Design, IEEE Press, 1995.
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