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[국내논문] 광통신 모듈용 155.52 MHz 클럭복원 리시버의 구현
Implementation of the 155.52 MHz Clock Recovery Receiver for the Fiber Optic Modules 원문보기

한국통신학회논문지. The Journal of Korea Information and Communications Society. 통신이론 및 시스템, v.26 no.12C, 2001년, pp.249 - 254  

이길재 (호서대학교 전자공학과) ,  채상훈 (호서대학교 전자공학과)

초록
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STM-1 체계의 광통신 수신부 광모듈에 내장하기 위한 리시버 ASIC을 0.65 $\mu\textrm{m}$ 실리콘 CMOS 기술을 이용하여 설계 제작하였다. 제작된 ASIC은 155.52 Mbps 데이터신호 재정형을 위한 제한 증폭기와 155.52 MHz 시스템 클럭을 추출하기 위한 클럭 복원 회로를 주축으로 구성되어 있다. 또한 이 리시버는 전원이 켜지는 초기 동작 상태에서나 동작 도중 데이터신호가 입력되지 않더라도 155.52 MHz 부근의 클럭 주파수를 유지하여 항상 안정된 동작을 할 수 있게 하기 위한 수렴 보조 회로 및 LOS 감지 회로도 내장하고 있다. 측정 결과 설계된 리시버는 5 mV-1 V의 넓은 입력 전압에 걸쳐 데이터 재정형이 이루어지며, 항상 안정된 클럭을 복원하고 있음을 알 수 있었다.

Abstract AI-Helper 아이콘AI-Helper

A receiver ASIC for fiber optic modules of STM-1 optical communication has been fabricated with 0.65 $\mu\textrm{m}$ CMOS technology. The ASIC has a limit amplifier circuit for the 155.52 Mbps data reshaping, and a clock extraction circuit for the 155.52 MHz clock recovery. The ASIC has a...

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문제 정의

  • 52MHz의 시스템 클럭을 추출하는 역할을 한다. 본 논문에서는 설계된 리시버의 회로 구성과 제작된 칩의 측정 결과에 대해 주로 기술하였다.
  • 52 MHz의 정상 주파수로 수렴하는데 많은 시간이 소요될 가능성이 있다. 본 연구에서는 이 문제를 해결하기 '위하여 PLL의 전압제어 발진기를 155.52 MHz의 안정된 상태로 신속하게 수렴시키는 수렴 보조 회로를 설계하였다. 이 회로는 그림 5에서와 같이 동작.
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