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선결정화법을 이용한 금속 유도 일측면 결정화에 의해 제작된 다결정 실리콘 박막 트랜지스터 소자 및 회로의 전기적 특성 개선 효과
Dynamic Characteristics of Metal-induced Unilaterally Crystallized Polycrystalline Silicon Thin-film Transistor Devices and Circuits Fabricated with Precrystallization 원문보기

韓國眞空學會誌 = Journal of the Korean Vacuum Society, v.17 no.5, 2008년, pp.461 - 465  

황욱중 (나노종합팹센터 정보전자부품소재기술혁신센터) ,  강일석 (나노종합팹센터 정보전자부품소재기술혁신센터) ,  김영수 (나노종합팹센터) ,  양준모 (나노종합팹센터 정보전자부품소재기술혁신센터) ,  안치원 (나노종합팹센터 정보전자부품소재기술혁신센터) ,  홍순구 (충남대학교 재료공학과)

초록
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적층 박막 내에서의 상변화는 주변 층에 영향을 준다. 결정화가 게이트 절연층에 주는 영향이 제거된 선결정화법(precrystallization)이 금속 유도 일측면 결정화(metal-induced unilateral crystallization)에 의해 제작된 다결정 실리콘 박막 트랜지스터 소자 및 회로의 전기적 특성에 미치는 영향에 대하여 연구하였다. 이 방법으로 만들어진 소자는 일반적인 후 결정화(postcrystallization) 소자에 비하여 높은 전류 구동력을 보였다. 여기에 본 연구는 DC bias에 의한 ring oscillator의 특성 변화를 연구하였다. 선결정화된 실리콘 박막을 이용하여 제작한 PMOS inverter는 후결정화된 실리콘 박막을 이용하여 제작한 inverter에 비하여 매우 동적(dynamic)이고도 안정적인 특성을 보였다.

Abstract AI-Helper 아이콘AI-Helper

The phase transformation in a film influences its surrounding. Effects of the precrystallization method, which removes influences on gate oxide caused by lateral crystallization, in metal-induced unilaterally crystallized polycrystalline silicon thin-film transistor devices and circuits were studied...

주제어

AI 본문요약
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제안 방법

  • 비교를 위하여 게이트 형성 후 측면 결정화와 도펀트 활성화를 동시에 진행한 post-TFT도 제작하였다. keithley 4200 semiconductor characterization system을 사용하여 전류-전압(I-V)곡선 그래프를 얻었다.
  • 게이트 절연층으로 700 Å 두께의 SiO2를, 게이트 금속의 접착력을 높이기 위하여 200 Å 두께의 Ti를, 그리고 게이트 금속 층으로 2000 Å 두께의 TiW을 각각 PECVD와 스퍼터링으로 증착하였다. 그리고 TiW, Ti, SiO2 세 층을 각각 RIE로 패터닝 하였다. 소오스와 드레인을 형성하기 위하여 B2H6를 도핑하였다(ion mass doping, IMD).
  • Si2H6 가스(disilane)를 사용하는 저압 화학기상증착(low-pressure CVD, LPCVD)으로 600 Å 두께의 비정질 실리콘을 증착하였다. 반응성 이온식각 (reactive ion etching, RIE)으로 실리콘 활성층을 패터닝한 후 MIUC의 촉매 금속인 100 Å 두께의 니켈 창 (window)을 lift-off 공정으로 형성하였다. 580 ℃ 수소 분위기에서 세 시간 동안 결정화를 진행하였다.
  • 즉, 전하를 띄는 interface state에 의한 Coulomb 산란이 이동도를 떨어뜨리게 되는 것이다. 본 연구에서 ring oscillator 제조에 사용한 pre-TFT와 post-TFT의 특성을 Fig. 3에 비교하였다. 이전 보고와 같이, pre-TFT의 이동도는 58 cm2/Vs로, post-TFT의 30 cm2/Vs에 비하여 높았다.
  • 본 연구에서는, 게이트 절연층이 측면 결정화의 영향을 받지 않도록 측면 결정화한 후 게이트를 형성한(선결정화, precrystallization) p-type TFT(이하 pre-TFT)를 제작 하였다. 선결정화가 MIUC poly-Si TFT의 전기적 특성에 미치는 영향을 관찰하였고, ring oscillator를 제작함으로써 선결정화로 제작된 소자가 주변 회로용으로 쓰이기에 적합함을 증명하였다.
  • 이후 contact window와 소오스/드레인 금속 라인 형성은 일반적인 TFT 제작 과정과 동일하게 진행하였다. 비교를 위하여 게이트 형성 후 측면 결정화와 도펀트 활성화를 동시에 진행한 post-TFT도 제작하였다. keithley 4200 semiconductor characterization system을 사용하여 전류-전압(I-V)곡선 그래프를 얻었다.
  • 선결정화법을 사용하여 부피 수축으로 발생되는 응력을 MIUC poly-Si TFT로부터 추출해 내었고, 이것이 소자와 회로의 전기적 특성에 미치는 영향을 연구하였다. 후결정 화와 비교하여 캐리어 이동도가 두 배 가까이 더 높았다.
  • 그리고 TiW, Ti, SiO2 세 층을 각각 RIE로 패터닝 하였다. 소오스와 드레인을 형성하기 위하여 B2H6를 도핑하였다(ion mass doping, IMD). 가속 전압과 RF 파워는 각각 15 kV와 150 W이었다.
  • pre-TFT의 자세한 제작 방법은 다음과 같다. 유리 기판 위에 플라즈마 화학기상증착 (plasma-enhanced chemical vapor deposition, PECVD)으로 완충층 3000 Å 두께의 실리콘 산화막(SiO2) 을 증착하였다. Si2H6 가스(disilane)를 사용하는 저압 화학기상증착(low-pressure CVD, LPCVD)으로 600 Å 두께의 비정질 실리콘을 증착하였다.

대상 데이터

  • 유리 기판 위에 플라즈마 화학기상증착 (plasma-enhanced chemical vapor deposition, PECVD)으로 완충층 3000 Å 두께의 실리콘 산화막(SiO2) 을 증착하였다. Si2H6 가스(disilane)를 사용하는 저압 화학기상증착(low-pressure CVD, LPCVD)으로 600 Å 두께의 비정질 실리콘을 증착하였다. 반응성 이온식각 (reactive ion etching, RIE)으로 실리콘 활성층을 패터닝한 후 MIUC의 촉매 금속인 100 Å 두께의 니켈 창 (window)을 lift-off 공정으로 형성하였다.
  • 580 ℃ 수소 분위기에서 세 시간 동안 결정화를 진행하였다. 게이트 절연층으로 700 Å 두께의 SiO2를, 게이트 금속의 접착력을 높이기 위하여 200 Å 두께의 Ti를, 그리고 게이트 금속 층으로 2000 Å 두께의 TiW을 각각 PECVD와 스퍼터링으로 증착하였다. 그리고 TiW, Ti, SiO2 세 층을 각각 RIE로 패터닝 하였다.
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질의응답

핵심어 질문 논문에서 추출한 답변
금속 유도 일측면 결정화에 의해 제작된 소자는 일반적인 후 결정화 소자에 비해 어떤 특성을 보였는가? 결정화가 게이트 절연층에 주는 영향이 제거된 선결정화법(precrystallization)이 금속 유도 일측면 결정화(metal-induced unilateral crystallization)에 의해 제작된 다결정 실리콘 박막 트랜지스터 소자 및 회로의 전기적 특성에 미치는 영향에 대하여 연구하였다. 이 방법으로 만들어진 소자는 일반적인 후 결정화(postcrystallization) 소자에 비하여 높은 전류 구동력을 보였다. 여기에 본 연구는 DC bias에 의한 ring oscillator의 특성 변화를 연구하였다.
금속 유도 일측면 결정화법은 어떤 기술인가? 유리 기판 위에 대면적으로 다결정 실리콘을 만드는 여러 방법[1-2] 중 금속 유도 일측면 결정화법(metal-induced unilateral crystallization, MIUC)은 가능성 높은 한 방법이다[3]. MIUC란 금속과 실리콘이 반응하여 형성된 금속 실리사이드가 촉매로써 결정화 온도를 낮추고 한쪽 측면으로부터 이동하면서 결정화가 진행되는 현상으로, 기존 양측 결정화가 지닌 단점, 즉 양쪽에서부터 결정화가 진행되 어온 경계(crystal growth joint) 결함을 채널 밖으로 제거 하는 기술이다.
현재까지 알려진 MIUC 메커니즘 모델은 어떠한가? 현재까지 알려진 MIUC 메커니즘 모델은 미시적으로 측면 결정화가 이루어지는 동안 결합의 파괴와 생성, 인장(tensile)과 압축(compressive) 변형(strain)이 반복해서 일어남을 보여 준다[4]. 이러한 일련의 변화들은 게이트 형성 후 측면 결정화와 도펀트 활성화(dopant activation)를 동시에 하는(후결정화, postcrystallization) 일반적인 TFT(이하 post-TFT)의 게이트 절연층 또는 게이트 절연 층과 실리콘 활성층(active layer) 사이의 계면에 영향을 줄 것이다.
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참고문헌 (10)

  1. R. B. Iverson and R. Reif, J. Appl. Phys. 62, 1675 (1987) 

  2. K. H. Kim, S. J. Park, K. S. Cho, W. S. Sohn, and J. Jang, SID Tech. Dig., 150 (2002) 

  3. Z. Meng, M. Wang,and M. Wong, IEEE Trans. Electron Devices 47, 404 (2000) 

  4. N. -K. Song, M. -S. Kim, S. -H. Han, Y. -S. Kim, and S. -K. Joo, J. Electrochem. Soc. 154, H370 (2007) 

  5. T. H. Kim, H. I. Kwon, J. D. Lee, and B. G. Park, Int. Microprocesses and Nanotechnology Conf. 2001, 240 (2001) 

  6. T. P. Leevard Pedersen, J. Kalb, W. K. Njoroge, D. Wamwangi, M. Wuttig, and F. Spaepen, Appl. Phys. Lett. 79, 3597 (2001) 

  7. A. Oishi, O. Fujii, T. Yokoyama, K. Ota, T. Sanuki, H. Inokuma, K. Eda, T. Idaka, H. Miyajima, S. Iwasa, H. Yamasaki, K. Oouchi, K. Matsuo, H. Nagano, T. Komoda, Y. Okayama, T. Matsumoto, K. Fukasaku, T. Shimizu, K. Miyano, T. Suzuki, K. Yahashi, A. Horiuchi, Y. Takegawa, K. Saki, S. Mori, K. Ohno, I. Mizushima, M. Saito, M. Iwai, S. Yamada, N. Nagashima, and F. Matsuoka, IEDM Tech. Digest, 239 (2005) 

  8. I. -S. Kang, S. -H. Han, and S. -K. Joo, Appl. Phys. Lett. 91, 092112 (2007) 

  9. S. Docking and M. Sachdev, IEEE J. Solid-State Circ. 39, 533 (2004) 

  10. J. H. Lee, M. Y. Shin, K. C. Moon, and M. K. Han, Phys. Scripta. T114, 199 (2004) 

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