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$0.18{\\mu}m$ CMOS 저 잡음 LDO 레귤레이터
A Low-Noise Low Dropout Regulator in $0.18{\\mu}m$ CMOS 원문보기

電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체, v.46 no.6 = no.384, 2009년, pp.52 - 57  

한상원 (광운대학교 전파공학과) ,  김종식 (광운대학교 전파공학과) ,  원광호 (전자부품연구원 유비쿼터스컴퓨팅센서) ,  신현철 (광운대학교 전파공학과)

초록
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본 논문은 CMOS RFIC 단일 칩을 위한 Bandgap Voltage Reference와 이를 포함한 저 잡음 Low Dropout (LDO) Regulator 회로에 관한 것이다. 저 잡음을 위해 Bandgap Voltage Reference에 사용된 BJT 다이오드의 유효면적을 증가시켜야 함을 LDO의 잡음해석을 통해 나타내었다. 이를 위해 다이오드를 직렬 연결하여 실리콘의 실제면적은 최소화 하면서 다이오드의 유효면적을 증가시키는 방법을 적용하였고, 이를 통해 LDO의 출력잡음을 줄일 수 있음을 확인하였다. $0.18{\mu}m$ CMOS 공정으로 제작된 LDO는 입력전압이 2.2 V 에서 5 V 일때 1.8 V의 출력전압에서 최대 90 mA의 전류를 내보낼 수 있다. 측정 결과 Line regulation은 0.04%/V 이고 Load regulation은 0.45%를 얻었으며 출력 잡음 레벨은 100 Hz와 1 kHz offset에서 각각 479 nV/$^\surd{Hz}$와 186 nV/$^\surd{Hz}$의 우수한 성능을 얻었다.

Abstract AI-Helper 아이콘AI-Helper

This paper presents a low-noise low-dropout linear regulator that is suitable for on-chip integration with RF transceiver ICs. In the bandgap reference, a stacked diode structure is adopted for saving silicon area as well as maintaining low output noise characteristic. Theoretical analysis for suppo...

주제어

AI 본문요약
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문제 정의

  • 본 논문에서는 LDO 출력잡음특성에 대한 이론적인 해석과 이를 바탕으로 저 잡음 Linear Regulator의 설계, 제작, 측정 결과를 제시하고자 한다.
본문요약 정보가 도움이 되었나요?

참고문헌 (6)

  1. S. K. Lau, P. K. T. Mok, and K. N. Leung, "A Low-Dropout Regulator for SoC with Q Reduction," IEEE J. Solid-State Circuit, vol. 42, no. 3, pp. 658-664, Mar. 2007 

  2. V. Gupta and G. A. Rincon-Mora, "A 5mA 0.6mm CMOS Miller-Compensated LDO Regulator with -27dB Worst-Case Power-Supply Rejection Using 60pF of On-Chip Capacitance, in IEEE Int. Solid-State Cir. Conf. Dig. Tech. Papers, pp. 520-521, Feb. 2007 

  3. J. J. Chen, F. C. Yang, C. M. KW1g, B. P. Lai, and Y. S Hwang, "A capacitor-free fast-transient-response LDO with dual-loop controlled paths," in Proc. IEEE Asian Solid-State Circuits Conference, pp. 364-367, Nov. 2007 

  4. K. N. Leung and P. K. T. Mok, "A capacitor-free CMOS low-dropout regulator with damping-factor-control frequency compensation," IEEE J. Solid- State Circuits, vol. 38, no. 10, pp. 1691-1702, Oct. 2003 

  5. Y. Wu, V. Aparin, "A monolithic low phase noise 1.7GHz CMOS VCO for zero-IF cellular CDMA receivers," in IEEE Int. Solid-State Cir. Conf. Dig. Tech. Papers, pp. 396-397, Feb. 2004 

  6. B. Razavi, Design of Analog CMOS Intergrated Circuits, New York: McGraw-Hill, 2001 

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