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나노초 펄스 레이저 응용 사파이어/실리콘 웨이퍼 미세 드릴링
Laser Micro-drilling of Sapphire/silicon Wafer using Nano-second Pulsed Laser 원문보기

한국정밀공학회지 = Journal of the Korean Society for Precision Engineering, v.27 no.2, 2010년, pp.13 - 19  

김남성 ((주)이오테크닉스 레이저 응용 연구소) ,  정영대 ((주)이오테크닉스 레이저 응용 연구소) ,  성천야 ((주)이오테크닉스 레이저 응용 연구소)

Abstract AI-Helper 아이콘AI-Helper

Due to the rapid spread of mobile handheld devices, industrial demands for micro-scale holes with a diameter of even smaller than $10{\mu}m$ in sapphire/silicon wafers have been increasing. Holes in sapphire wafers are for heat dissipation from LEDs; and those in silicon wafers for interl...

주제어

AI 본문요약
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문제 정의

  • 하지만 에칭은 설비가 비싸고 환경적이 문제가 있으며 기계적 드릴링은 유지비용 및 기계적인 최소 흘의 한계 때문에 새로운 방식이 요구 되고 있다. 따라서 본 연구에서는 Nd:YVO4 레이저의 제 2 고조파인 532nm 파장의 레이저를 사용하여 LED 소자의 기판으로 사용되는 직경 2 인치, 두께 430|im 의 사파이어 웨이퍼에 고속으로 미세 홀을 드릴링할 수 있는 시스템을 개발하였다.
  • 따라서 본 연구에서는 이 현상을 개선하기 위해서 가공 시 실리콘 웨이퍼 표면에 표면 장력 값이 매우 낮은 PVA 물질을 도포하여 웨이퍼 표면에 고르게 유동성 액체를 도포함으로써 가공 시발 생하는 실리콘 입자들이 도포된 PVA 물질 위에서 응고되게 만들고, 가공 시 웨이퍼 표면을 공기 중의 산소와 격리시켜서 plume 발생을 억제 시켜서 plasma 발생에 따른 열적 표면 손상을 최소화하기 위해 cooling 레이저 공정인 coating & cleaning 공정을 테스트 하여 표면 분진이 제거되는 현상을 확인하였다.
  • 본 기술의 목적은 미세 천공의 위치 보정과 정밀도 향상, 그리고 가공 홀의 다양한 품질을 구현이다. 이를 위해 먼저 드릴링 가공을 위해서 드릴링 전용의 S/W 를 제 작하였 다(Fig.
  • Y 스캐너 제어 기술이다. 본 연구에서는 레이저 및 스캐너 광학계를 정밀 제어 할 수 있는 컨트롤 보드를 자체 개발하여 핵심 기술의 국산화를 도모하였다. 500kHz 까지 레이 저 모듈레 이 션 발진 신호를 정 밀하게 발생시킬 수 있으며 스캐너를 정밀하고 고속으로 제어할 수 있도록 동작 클럭 20MHz 의 레이저 발진 및 스캐너 제어보드를 개발하였으며 향후 레이저 드릴 장비의 고속화를 추구하기 위하여 XY 스캐너 4쌍을 한 번에 제어할 수 있도록 4 빔 지원의 스캐너를 개발하여 레이저 발진 안정화 및 스캐너 위치 정밀도 확보하였다.
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참고문헌 (8)

  1. Korea Institute of Science and Technology Information, "LED Technical Trend Report," pp. 6-11, 2007 

  2. Terrill, R. and Beene, G. L., "3D packaging technology overview and mass memory applications," IEEE Proc. of Aerospace Applications Conference, Vol. 2, pp. 347-355, 1996. 

  3. Campbell, M. L., Toborg, S. T. and Taylor, S. L., "3D wafer stack neurocomputing," Fifth Annual IEEE International Conference on Wafer Scale Integration, pp. 67-74, 1993. 

  4. Bertagnolli, E., Bollmann, D., Braun, R., Buchner, R., Engelhardt, M., Grassl, T., Hieber, K., Kawala, G., Kleiner, M., Klumpp, A., Kuhn, S., Landesberger, C., Pamler, W., Popp, R., Ramm, P., Renner, E., Ruhl, G., Scheler, U., Schmidt, C., Schwarzl, S., Weber, J. and Sanger, A., "Interchip via technology-three dimensional metallization for vertically integrated circuits," Fourth International Symposium on Semiconductor Wafer Bonding, pp. 509-520, 1997. 

  5. Laydevant, J. L., "High Speed Via Drilling for 3D Interconnect Industrialization," Encasit Workshop, 2006. 

  6. Hirafune, S., Yamamoto, S., Wada, H., Okanishi, K., Tomita, M., Matsumaru, K. and Suemasu, T., "Packaging Technology for Imager Using Throughhole Interconnections in Si Substrate," 6th IEEE CPMT Conference on High Density Microsystem Design and Packaging, pp. 303-306, 2004. 

  7. Bauer, T., "High Density Through Wafer Via Technology," NSTI Nanotech, Vol. 3, pp. 116-119, 2007. 

  8. Brennan, N., Callaghan, J., Hannon, M. and Rodin, A., "High-Throughput Laser Percussion Interconnect Microvia Process," WLT-Conference on Lasers in Manufacturing, 2007. 

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